參數(shù)資料
型號： MAX14824GTG+T
廠商： Maxim Integrated Products
文件頁數(shù)： 6/28頁
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描述： IC IO-LINK MASTER TXRX 24TQFN
標(biāo)準(zhǔn)包裝： 2,500
系列： *
14
MAX14824
IO-Link Master Transceiver
Pin Configuration
Pin Description
PIN
NAME
FUNCTION
1
LDOIN
5V Linear-Regulator Input. Bypass LDOIN to GND with a 0.1FF ceramic capacitor.
2
V5
5V Power-Supply Input and 5V Linear-Regulator Output. Bypass V5 to GND with a 0.1FF ceramic capacitor.
See the 5V and 3.3V Linear Regulators section for more information.
3
LDO33
3.3V Linear-Regulator Output. Bypass LDO33 to GND with a 1FF ceramic capacitor.
4
IRQ
Active-Low Interrupt Request Output. IRQ is a push-pull output referenced to VL.
5
SCLK
SPI Clock Input
6
CS
SPI Chip-Select Input
7
SDO
SPI Serial-Data Output Port
8
SDI
SPI Serial-Data Input Port
9
VL
Logic-Level Supply Input. VL defines the logic levels on all the logic inputs and outputs. Bypass VL to
GND with a 0.1FF ceramic capacitor.
10
A3
Chip-Select Address Input 3. Do not leave A3 unconnected.
11
TXQ
Transmit Level Input. TXQ is ANDed with TXC. Drive TXQ high if not in use.
12
TXC
Transmit Communication Input. TXC is ANDed with TXQ. Drive TXC high if not in use.
13
TXEN
Transmitter Enable. Driving TXEN high enables the C/Q transmitter. While the C/Q transmitter is enabled,
the C/Q current sink is turned off.
23
24
22
21
8
7
9
V 5
IRQ
SCLK
CS
10
LDOIN
LI
WUEN
RX
UV
TXEN
12
A1
45
6
17
18
16
14
13
VCC
A0
A3
VL
SDI
SDO
*EP
*CONNECT EXPOSED PAD TO GND.
LDO33
A2
3
15
C/Q
20
11 TXQ
GND
19
12 TXC
DI
TQFN
(4mm × 4mm)
TOP VIEW
+
MAX14824
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PDF描述
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參數(shù)描述
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