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參數(shù)資料
型號： MAX1243ACSA+
廠商： Maxim Integrated Products
文件頁數(shù)： 8/13頁
文件大?。?/td> 0K
描述： IC ADC 10BIT SERIAL 8-SOIC
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 100
位數(shù)： 10
采樣率（每秒）： 73k
數(shù)據(jù)接口： MICROWIRE?，QSPI?，串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 471mW
電壓電源： 單電源
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應商設備封裝： 8-SOIC
包裝： 管件
輸入數(shù)目和類型： 1 個單端，單極
MAX1242/MAX1243
+2.7V to +5.25V, Low-Power, 10-Bit
Serial ADCs in SO-8
4
Maxim Integrated
TIMING CHARACTERISTICS
(VDD = +2.7V to +5.25V, circuit of Figure 9, TA = TMIN to TMAX, unless otherwise noted.)
Note 1: Tested at VDD = +2.7V.
Note 2: Relative accuracy is the deviation of the analog value at any code from its theoretical value after the full-scale range and
offset have been calibrated.
Note 3: Offset nulled.
Note 4: Sample tested to 0.1% AQL.
Note 5: External load should not change during conversion for specified accuracy.
Note 6: Guaranteed by design. Not subject to production testing.
Note 7: Measured as [VFS (VDD(min)) - VFS (VDD(max))].
Note 8: To guarantee acquisition time, tACQ is the maximum time the device takes to acquire the signal, and is also the minimum
time needed for the signal to be acquired.
DOUT
6k
Ω
DGND
CLOAD = 50pF
6k
Ω
DGND
+2.7V
b) High-Z to VOL and VOH to VOL
a) High-Z to VOH and VOL to VOH
DOUT
6k
Ω
DGND
CLOAD = 50pF
6k
Ω
DGND
+2.7V
b) VOLto High-Z
a) VOH to High-Z
Figure 1. Load Circuits for DOUT Enable Time
Figure 2. Load Circuits for DOUT Disable Time
MAX124_ _C/E
Figure 1, CLOAD = 50pF
Figure 1,
CLOAD = 50pF
CS = VDD (Note 8)
Figure 2, CLOAD = 50pF
CONDITIONS
ns
240
tDV
CS Fall to Output Enable
ns
20
200
tDO
s
1.5
tACQ
Acquisition Time
SCLK Fall to Output Data Valid
ns
240
tCS
CS Pulse Width
ns
0
tSTR
DOUT Rise to SCLK Rise (Note 6)
ns
50
tCS0
SCLK Low to CS Fall Setup Time
ns
240
tTR
CS Rise to Output Disable
MHz
0
2.1
fSCLK
SCLK Clock Frequency
ns
200
tCH
SCLK Pulse Width High
ns
200
tCL
SCLK Pulse Width Low
UNITS
MIN
TYP
MAX
SYMBOL
PARAMETER
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PDF描述
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