參數(shù)資料
型號(hào)： M7A3P600-FFG484
元件分類： FPGA
英文描述： FPGA, 600000 GATES, 350 MHz, PBGA484
封裝： 1 MM PITCH, FBGA-484
文件頁數(shù)： 7/246頁
文件大小： 3010K
代理商： M7A3P600-FFG484
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ProASIC3 Flash Family FPGAs
3- 34
v2.1
2.5 V LVCMOS
Low-Voltage CMOS for 2.5 V is an extension of the LVCMOS standard (JESD8-5) used for general purpose 2.5 V
applications. It uses a 5 V–tolerant input buffer and push-pull output buffer.
Applicable to Advanced I/O Banks
2.5 V
LVCMOS
VIL
VIH
VOL
VOH
IOL
IOH
IOSL
IOSH
IIL
IIH
Drive
Strength
Min., V
Max., V
Min., V Max., V
Max., V
Min., V
mA
Max.,
mA1
Max.,
mA1
A2
2 mA
–0.3
0.7
1.7
3.6
0.7
1.7
2
18
16
10
4 mA
–0.3
0.7
1.7
3.6
0.7
1.7
4
18
16
10
6 mA
–0.3
0.7
1.7
3.6
0.7
1.7
6
37
32
10
8 mA
–0.3
0.7
1.7
3.6
0.7
1.7
8
37
32
10
12 mA
–0.3
0.7
1.7
3.6
0.7
1.7
12
74
65
10
16 mA
–0.3
0.7
1.7
3.6
0.7
1.7
16
87
83
10
24 mA
–0.3
0.7
1.7
3.6
0.7
1.7
24
124
169
10
Notes:
1. Currents are measured at high temperature (100°C junction temperature) and maximum voltage.
2. Currents are measured at 85°C junction temperature.
3. Software default selection highlighted in gray.
Table 3-44 Minimum and Maximum DC Input and Output Levels
Applicable to Standard Plus I/O Banks
2.5 V
LVCMOS
VIL
VIH
VOL
VOH
IOL
IOH
IOSL
IOSH
IIL
IIH
Drive
Strength
Min., V
Max., V
Min., V Max., V
Max., V
Min., V
mA
Max.,
mA1
Max.,
mA1
A2
2 mA
–0.3
0.7
1.7
3.6
0.7
1.7
2
18
16
10
4 mA
–0.3
0.7
1.7
3.6
0.7
1.7
4
18
16
10
6 mA
–0.3
0.7
1.7
3.6
0.7
1.7
6
37
32
10
8 mA
–0.3
0.7
1.7
3.6
0.7
1.7
8
37
32
10
12 mA
–0.3
0.7
1.7
3.6
0.7
1.7
12
74
65
10
Notes:
1. Currents are measured at high temperature (100°C junction temperature) and maximum voltage.
2. Currents are measured at 85°C junction temperature.
3. Software default selection highlighted in gray.
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