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參數資料
| 型號： | M38039M6-XXXKP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單芯片8位CMOS微機 |
| 文件頁數： | 67/119頁 |
| 文件大?。?/td> | 1575K |
| 代理商： | M38039M6-XXXKP |
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Rev.1.00
REJ03B0212-0100
Apr 2, 2007
Page 67 of 117
3803 Group (Spec.L)
Fig 65. System clock generating circuit block diagram (Single-chip mode)
WIT
instruction
STP
instruction
Timing
φ
(internal clock)
S
R
Q
S
R
Q
Main clock stop bit
S
R
Q
1/2
1/4
X
IN
X
OUT
X
COUT
X
CIN
Interrupt request
Interrupt disable flag l
Reset
Port X
C
switch bit
“1”
“0”
Low-speed
mode
High-speed or
middle-speed mode
Middle-speed mode
High-speed or
low-speed mode
Main clock division ratio
selection bits
(1)
Main clock division ratio
selection bits
(1)
Notes1
: Either high-speed, middle-speed or low-speed mode is selected by bits 7 and 6 of the CPU mode register.
When low-speed mode is selected, set port X
C
switch bit (b4) to “1”.
2
: f(X
IN
)/16 is supplied as the count source to the prescaler 12 at reset, the count source before executing the STP instruction is
supplied as the count source at executing STP instruction.
3
: When bit 0 of MISRG is “0”, timer 1 is set “01
16
” and prescaler 12 is set “FF
16
” automatically. When bit 0 of MISRG is “1” , set the
appropriate value to them in accordance with oscillation stabilizing time required by the using oscillator because nothing is
automatically set into timer 1 and prescaler 12.
4
: Although a feed-back resistor exists on-chip, an external feed-back resistor may be needed depending on conditions.
Prescaler 12
Timer 1
Reset or
STP instruction
(2)
Reset
(3)
(4)
STP
instruction
Divider
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