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參數(shù)資料
| 型號： | M38038MA-XXXHP |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | 512K x 8 Static RAM; Density: 4 Mb; Organization: 512Kb x 8; Vcc (V): 4.5 to 5.5 V; |
| 中文描述： | 單芯片8位CMOS微機(jī) |
| 文件頁數(shù)： | 61/119頁 |
| 文件大小： | 1575K |
| 代理商： | M38038MA-XXXHP |
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Rev.1.00
REJ03B0212-0100
Apr 2, 2007
Page 61 of 117
3803 Group (Spec.L)
D/A CONVERTER
The 3803 group (Spec.L) has two internal D/A converters (DA
1
and DA
2
) with 8-bit resolution.
The D/A conversion is performed by setting the value in each
DA conversion register. The result of D/A conversion is output
from the DA
1
or DA
2
pin by setting the DA output enable bit to
“1”.
When using the D/A converter, the corresponding port direction
register bit (P3
0
/DA
1
or P3
1
/DA
2
) must be set to “0” (input
status).
The output analog voltage V is determined by the value n
(decimal notation) in the DA conversion register as follows:
V = V
REF
× n/256 (n = 0 to 255)
Where V
REF
is the reference voltage.
At reset, the DA conversion registers are cleared to “00
16
”, and
the DA output enable bits are cleared to “0”, and the P3
0
/DA
1
and P3
1
/DA
2
pins become high impedance.
The DA output does not have buffers. Accordingly, connect an
external buffer when driving a low-impedance load.
Fig 56. Block diagram of D/A converter
Fig 57. Equivalent connection circuit of D/A converter (DA1)
DA
1
conversion register (8)
DA
1
output enable bit
P3
0
/DA
1
D
R-2R resistor ladder
DA
2
conversion register (8)
DA
2
output enable bit
P3
1
/DA
2
R-2R resistor ladder
DA
1
output enable bit
AV
SS
V
REF
R
2R
R
R
R
R
R
R
2R
2R
2R
2R
2R
2R
2R
2R
LSB
“1”
“0”
MSB
DA
1
conversion register
P3
0
/DA
1
“0”
“1”
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