參數(shù)資料
型號(hào)： M37902FHCHP
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100
文件頁(yè)數(shù)： 520/556頁(yè)
文件大小： 3722K
代理商： M37902FHCHP
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CONNECTION WITH EXTERNAL DEVICES
7902 Group User’s Manual
3-11
3.2 Chip select wait controller
(3) CS0 control register L
Figure 3.2.3 shows the structure of the CS0 control register L.
CS0 control register L (Address 8016)
b7 b6 b5 b4 b3 b2 b1 b0
Notes 1: This bit is “0” when Vss-level voltage is applied to pin BYTE; this bit is “1” when Vcc-level voltage is applied.
2: This bit is valid when the RDY input select bit (bit 2 at address 5F16) is “1.”
3: When Vcc-level voltage is applied to pin BYTE, “normal access” is selected regardless of this bit’s value.
4: This bit’s contents are invalid in the single-chip mode. (CS0 output disabled)
5: This bit is “0” when Vss-level voltage is applied to pin MD0; this bit is “1” when Vcc-level voltage is applied. (Fixed to “1.”)
The input level at pin BYTE is read out.
0 : 16-bit width
1 : 8-bit width
0 : RDY control is valid.
1 : RDY control is invalid.
0 : Normal access
1 : Burst ROM access
0 : No recovery cycle is inserted at access to area CS0.
1 : Recovery cycle is inserted at access to area CS0.
0 : CS0 output is disabled. (P44 functions as a
programmable I/O port pin.)
1 : CS0 output is enabled. (P44 functions as pin CS0.)
Bit name
Bit
Function
At reset
R/W
0
1
2
3
4
5
6
7
Area CS0 bus cycle select bit 0
External data bus width select bit
RDY control bit
(Note 2)
The value is “0” at reading.
Burst ROM access select bit
(Note 3)
Recovery cycle insert select bit
CS0 output select bit
(Note 4)
RW
RO
RW
—
RW
0
1
(Note 1)
0
1
(Note 5)
0 0 : 1
φ + 1φ
0 1 : 1
φ + 2φ
1 0 : 1
φ + 3φ
1 1 : 2
φ + 2φ
b0
b1
0 0 : 2
φ + 3φ
0 1 : 2
φ + 4φ
1 0 : 3
φ + 3φ
1 1 : 3
φ + 4φ
b0
b1
(Area CS0 bus cycle select
bit 1 = 0)
(Area CS0 bus cycle select
bit 1 = 1)
Fig. 3.2.3 Structure of CS0 control register L
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