參數(shù)資料
型號(hào)： M37902FHCGP
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100
文件頁數(shù)： 311/556頁
文件大小： 3722K
代理商： M37902FHCGP
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APPLICATIONS
7902 Group User’s Manual
19-8
19.1 Connection examples with external devices
69 ns or less
46 ns or less
60 ns or less
6 ns or more
0 ns or more
Table 19.1.1 Timing requirements of flash memory (f(fsys) = 26 MHz)
Address access time
OE access time
CE access time
Output disable time
Data setup time
Data hold time
CE setup time before write
Reading
Writing
Bus cycle = 2
φ + 2φ
107 ns or less
46 ns or less
98 ns or less
0ns or more
56 ns or less
9 ns or less
38 ns or less
145 ns or less
84 ns or less
136 ns or less
0ns or more
94 ns or less
9 ns or less
38 ns or less
Address access time
OE access time
CE access time
Output disable time
Reading
107 ns or less
84 ns or less
98 ns or less
0 ns or more
183 ns or less
122 ns or less
174 ns or less
0 ns or more
Conditions
Item
Address access time
OE access time
CE access time
BC1/BC2 access time
Output enable time after OE enabled
Output disable time
Data setup time
Data hold time
Reading
Writing
(46 ns – propagation delay time of g2) or less
(56 ns + propagation delay time of g1) or less
Bus cycle = 2
φ + 3φ
Bus cycle = 1
φ + 1φ
Conditions
Item
Bus cycle = 1
φ + 2φ
Bus cycle = 1
φ + 3φ
Conditions
Item
Bus cycle = 2
φ + 4φ
(Note 1)
(Note 2)
(Note 1)
(Note 2)
Notes 1: This applies when the address output select bit (bit 4 at address 6316) = “0.”
2: Recovery insertion of 2 cycles allows “the data hold time” to be extended by 38 ns, moreover.
(Note)
Note: This applies when the address output select bit (bit 4 at address 6316) = “0.”
Notes 1: This applies when the address output select bit (bit 4 at address 6316) = “0.”
2: Recovery insertion of 1 cycle allows “the output enable time after OE enabled” to be set to “0 ns or more.”
3: Recovery insertion of 2 cycles allows “the data hold time” to be extended by 38 ns, moreover.
(Note 1)
(Note 2)
(Note 3)
Table 19.1.2 Timing requirements of mask ROM (f(fsys) = 26 MHz)
Table 19.1.3 Timing requirements of SRAM (! 16) (f(fsys) = 26 MHz)
(Note 1)
(Note 2)
(Note 3)
31 ns or less
8 ns or less
22 ns or less
6 ns or more
0 ns or more
(8 ns – propagation delay time of g2) or less
(18 ns + propagation delay time of g1) or less
(9 ns – propagation delay time of g1) or less
相關(guān)PDF資料
PDF描述
M37902FHMHP 16-BIT, FLASH, MICROCONTROLLER, PQFP100
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參數(shù)描述
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