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參數(shù)資料
| 型號(hào)： | M37272M8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | Single Chip 8 Bits Microcomputer(8位單片機(jī)) |
| 中文描述： | 單芯片8位單片機(jī)（8位單片機(jī)） |
| 文件頁數(shù)： | 100/142頁 |
| 文件大?。?/td> | 1427K |
| 代理商： | M37272M8 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁當(dāng)前第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁
100
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER
and ON-SCREEN DISPLAY CONTROLLER
M37272M6/M8–XXXSP/FP, M37272MA–XXXSP
M37272E8SP/FP, M37272EFSP
MITSUBISHI MICROCOMPUTERS
Rev. 1.3
13. A-D CONVERTER CHARACTERISTICS
(V
CC
= 5 V ± 10 %, V
SS
= 0 V, f(X
IN
) = 8 MHz, T
a
= –10 °C to 70 °C, unless otherwise noted)
Resolution
Non-linearity error
Differencial non-linearity error
Zero transition error
Full-scale transition error
Max.
6
±1
±0.9
2
–2
bits
LSB
LSB
LSB
LSB
Min.
Limits
Typ.
Unit
Test conditions
Parameter
Symbol
—
—
—
V
0T
V
FST
I
OL
(SUM) = 0 mA
14. MULTI-MASTER I
2
C-BUS BUS LINE CHARACTERISTICS
Bus free time
Hold time for START condition
LOW period of SCL clock
Rising time of both SCL and SDA signals
Data hold time
HIGH period of SCL clock
Falling time of both SCL and SDA signals
Data set-up time
Set-up time for repeated START condition
Set-up time for STOP condition
t
BUF
t
HD; STA
t
LOW
t
R
t
HD; DAT
t
HIGH
t
F
t
SU; DAT
t
SU; STA
t
SU; STO
Max.
1000
300
Min.
1.3
0.6
1.3
20+0.1C
b
0
0.6
20+0.1C
b
100
0.6
0.6
Max.
300
0.9
300
μ
s
μ
s
μ
s
ns
μ
s
μ
s
ns
ns
μ
s
μ
s
Unit
Standard clock mode High-speed clock mode
Min.
4.7
4.0
4.7
Parameter
Symbol
Note:
C
b
= total capacitance of 1 bus line
Fig.14.1 Definition Diagram of Timing on Multi-master I
2
C-BUS
0
4.0
250
4.7
4.0
S
D
A
S
C
L
P
t
B
U
F
S
t
H
D
;
S
T
A
t
L
O
W
t
R
t
H
D
;
D
A
T
t
H
I
G
H
t
F
t
S
U
;
D
A
T
t
S
U
;
S
T
A
S
r
P
t
S
U
;
S
T
O
t
H
D
;
S
T
A
S
S
P
r
:
:
:
S
R
S
t
e
t
o
a
r
t
t
a
c
r
c
o
t
o
n
c
n
d
o
d
i
n
i
t
t
i
d
i
o
o
n
i
t
n
s
p
i
o
n
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參數(shù)描述 |
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