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參數(shù)資料
| 型號： | M34509G4FP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDSO24 |
| 封裝： | 5.30 X 10.10 MM, 0.80 MM PITCH, PLASTIC, SSOP-24 |
| 文件頁數(shù)： | 100/143頁 |
| 文件大?。?/td> | 1056K |
| 代理商： | M34509G4FP |
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Rev.1.03
2009.07.27
page 6 of 140
REJ03B0147-0103
4509 Group
DEFINITION OF CLOCK AND CYCLE
● Operation source clock
The operation source clock is the source clock to operate this
product. In this product, the following clocks are used.
Clock (f(XIN)) by the external ceramic resonator
Clock (f(XIN)) by the external RC oscillation
Clock (f(XIN)) by the external input
Clock (f(RING)) of the on-chip oscillator which is the internal os-
cillator.
● System clock
The system clock is the basic clock for controlling this product.
The system clock is selected by the register MR and register RG.
● Instruction clock
The instruction clock is a signal derived by dividing the system
clock by 3. The one instruction clock cycle generates the one ma-
chine cycle.
● Machine cycle
The machine cycle is the standard cycle required to execute the
instruction.
Register MR, RG
System clock
f(STCK) = f(RING)/8
f(STCK) = f(RING)/4
f(STCK) = f(RING)/2
f(STCK) = f(RING)
f(STCK) = f(XIN)/8
f(STCK) = f(XIN)/4
f(STCK) = f(XIN)/2
f(STCK) = f(XIN)
Table Selection of system clock
Note: The internal frequency divided by 8 is selected after system is released from reset.
MR2
1
0
1
0
1
0
1
0
MR3
1
0
1
0
Operation mode
Internal frequency divided by 8 mode
Internal frequency divided by 4 mode
Internal frequency divided by 2 mode
Internal frequency through mode
High-speed frequency divided by 8 mode
High-speed frequency divided by 4 mode
High-speed frequency divided by 2 mode
High-speed through mode
MR0
1
0
MR1
–
0
RG0
0
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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