參數(shù)資料
型號： M32172F2VWG
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA175
封裝： BGA-175
文件頁數(shù)： 377/875頁
文件大小： 3580K
代理商： M32172F2VWG
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11
11-21
Rev.1.0
(1) ADnSTRG1 and ADnSTRG0 (A-Dn hardware trigger select) bits (D0, D2)
When starting A-D conversion of the A-Dn converter in hardware, these bits select the cause for
which to start conversion (TOM0_6 underflow, input on external pin TIN16, TOM0_0-7 enable
event, or completion of A-D1 conversion for A-D0; TOM0_6 underflow, input on external pin
TIN16, TOM1_6 underflow, or completion of A-D0 conversion for A-D1). If software trigger is
selected with the ADnSSEL (A-Dn conversion start trigger select) bit, the contents of these bits
are ignored.
(2) ADnSSEL (A-Dn conversion start trigger select) bit (D3)
This bit selects whether to apply the A-Dn conversion start trigger in software or in hardware
during single mode.
When software trigger is selected, A-D conversion is started by setting the ADnSSTT (A-Dn
conversion start) bit to 1. When hardware trigger is selected, A-D conversion is started by the
cause of conversion selected with the ADnSTRG0 (hardware trigger select 0) and ADnSTRG1
(hardware trigger select 1) bits.
(3) ADnSREQ (A-Dn interrupt request/DMA transfer request select) bit (D4)
This bit selects whether to generate an A-Dn conversion interrupt request or a DMA transfer
request at completion of A-Dn converter operation in single mode (A-D conversion or
comparate). When using neither interrupt nor DMA transfer, select A-Dn conversion interrupt
request and mask it with the ICU's A-Dn Converter Interrupt Control Register, or select DMA
transfer and disable the DMA transfer to be started at completion of A-Dn conversion with the
DMAn Channel Control Register.
(4) ADnSCMP (A-Dn conversion/comparate complete) bit (D5)
This is a read-only bit, and is 1 when reset. This bit is 0 when the A-Dn converter is operating in
single mode (A-D conversion or comparate) and set to 1 when the operation is completed.
It also is set to 1 when A-D convert or comparate operation is forcibly terminated by setting the
ADnSSTT (A-Dn conversion stop) bit to 1 during A-D conversion or comparate.
(5) ADnSSTP (A-Dn conversion stop) bit (D6)
The A-Dn converter operating in single mode (A-D conversion or comparate) can be stopped by
setting this bit to 1 while the operation is in progress. Manipulation of this bit is ignored while the
converter when in single mode remains idle or is operating in scan mode.
Operation is stopped immediately after writing to this bit, and when the content of the "A-Dn
Successive Approximation Register" is read after stopping the operation, it shows an
intermediate value that was in the middle of conversion. (No transfers to the A-Dn Data Register
are performed.)
A-D CONVERTERS
11.2 A-D Converter Related Registers
相關PDF資料
PDF描述
M32173F2VFP 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP144
M32174F4VFP 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP240
M32170F6VWG 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PBGA255
M32176F3TFP 32-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP144
M32176F2VFP 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
相關代理商/技術參數(shù)
參數(shù)描述
M32173T-PTC 功能描述:DEV CONNECTION CNVTR FOR 32172, RoHS:否 類別:編程器，開發(fā)系統(tǒng) >> 配件 系列:- 產(chǎn)品培訓模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program RoHS指令信息:IButton RoHS Compliance Plan 標準包裝:1 系列:- 附件類型:USB 至 1-Wire? RJ11 適配器 適用于相關產(chǎn)品:1-Wire? 設備 產(chǎn)品目錄頁面:1429 (CN2011-ZH PDF)
M32174F3VFP 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER
M32174F3VWG 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER
M32174F4VFP 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER
M32174F4VWG 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER
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