Revision 4 2-223 Timing Characteristics Figure 2-143 Input DDR Timing Diagram " /> 
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    參數(shù)資料
    

    


    


    
型號：
M1AFS250-PQG208

    

    
廠商：
Microsemi SoC

    

    
文件頁數(shù)：
156/334頁

    

    
文件大?。?/td>
0K

    

    
描述：
IC FPGA 2MB FLASH 250K 208-PQFP

    

    
標(biāo)準(zhǔn)包裝：
24

    

    
系列：
Fusion®

    

    
RAM 位總計：
36864
    		

    

    
輸入/輸出數(shù)：
93
    		

    

    
門數(shù)：
250000
    		

    

    
電源電壓：
1.425 V ~ 1.575 V
    		

    

    
安裝類型：
表面貼裝
    		

    

    
工作溫度：
0°C ~ 85°C
    		

    

    
封裝/外殼：
208-BFQFP
    		

    

    
供應(yīng)商設(shè)備封裝：
208-PQFP（28x28）
    		

    

    

    

	
    
    
    
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    Fusion Family of Mixed Signal FPGAs
    Revision 4
    2-223
    Timing Characteristics
    Figure 2-143  Input DDR Timing Diagram
    tDDRICLR2Q2
    tDDRIREMCLR
    tDDRIRECCLR
    tDDRICLR2Q1
    12
    3
    4
    5
    6
    7
    8
    9
    CLK
    Data
    CLR
    Out_QR
    Out_QF
    tDDRICLKQ1
    2
    4
    6
    3
    5
    7
    tDDRIHD
    tDDRISUD
    tDDRICLKQ2
    Table 2-180  Input DDR Propagation Delays
    Commercial Temperature Range Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
    Parameter
    Description
    –2
    –1
    Std.
    Units
    tDDRICLKQ1
    Clock-to-Out Out_QR for Input DDR
    0.39
    0.44
    0.52
    ns
    tDDRICLKQ2
    Clock-to-Out Out_QF for Input DDR
    0.27
    0.31
    0.37
    ns
    tDDRISUD
    Data Setup for Input DDR
    0.28
    0.32
    0.38
    ns
    tDDRIHD
    Data Hold for Input DDR
    0.00
    ns
    tDDRICLR2Q1
    Asynchronous Clear-to-Out Out_QR for Input DDR
    0.57
    0.65
    0.76
    ns
    tDDRICLR2Q2
    Asynchronous Clear-to-Out Out_QF for Input DDR
    0.46
    0.53
    0.62
    ns
    tDDRIREMCLR Asynchronous Clear Removal Time for Input DDR
    0.00
    ns
    tDDRIRECCLR
    Asynchronous Clear Recovery Time for Input DDR
    0.22
    0.25
    0.30
    ns
    tDDRIWCLR
    Asynchronous Clear Minimum Pulse Width for Input DDR
    0.22
    0.25
    0.30
    ns
    tDDRICKMPWH Clock Minimum Pulse Width High for Input DDR
    0.36
    0.41
    0.48
    ns
    tDDRICKMPWL Clock Minimum Pulse Width Low for Input DDR
    0.32
    0.37
    0.43
    ns
    FDDRIMAX
    Maximum Frequency for Input DDR
    1404
    1232
    1048
    MHz
    Note: For the derating values at specific junction temperature and voltage supply levels, refer to Table 3-7 on
    
    
    
    
    
    


    


    

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    PDF描述
    		

    
    

    
ABM43DTMN-S189
CONN EDGECARD 86POS R/A .156 SLD

    

    
EP4CE22E22I8L
IC CYCLONE IV FPGA 22K 144EQFP

    

    
EP4CE22E22I7
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    參數(shù)描述
    		

    
    

    
M1AFS250-PQG208I
功能描述:IC FPGA 2MB FLASH 250K 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Fusion® 標(biāo)準(zhǔn)包裝:40 系列:SX-A LAB/CLB數(shù):6036 邏輯元件/單元數(shù):- RAM 位總計:- 輸入/輸出數(shù):360 門數(shù):108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FPBGA（27X27）

    

    
M1AFS250-PQG256ES
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs

    

    
M1AFS250-PQG256I
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs

    

    
M1AFS250-PQG256PP
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs

    

    
M1AFS250-QN256ES
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs

    

    
    
    
    
	
    	
    
    
     
     
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                                    廠商
                                    批號
                                    封裝
                                  
    
                                    
                                
                                
    
                                    
                                        
    
                                            
                                            
                                        
    
                                        		
                                     
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                  
    
                                  
                                   
                                    
                            
    
                             
                             
							                            
    
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    我的聯(lián)系方式
    
                     
                     
                       
    
                                
                                
                                
    
                                    
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