參數(shù)資料
型號(hào)： LTC2428CG
廠商： LINEAR TECHNOLOGY CORP
元件分類： ADC
英文描述： 4-/8-Channel 20-Bit uPower No Latency ADCs
中文描述： 8-CH 20-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO28
封裝： 0.209 INCH, PLASTIC, SSOP-28
文件頁(yè)數(shù)： 18/28頁(yè)
文件大?。?/td> 317K
代理商： LTC2428CG
18
LTC2424/LTC2428
Figure 15. External Serial Clock with Reduced Data Output Length Timing Diagram
SCK/CLK
SDO
D
IN
CSADC/
CSMUX
V
CC
CS
SCK
F
O
FS
SET
CSMUX
CSADC
SCK
CLK
MUXOUT
ADCIN
D
IN
SDO
ZS
SET
GND
0.1V
TO V
CC
–0.12V
REF
TO 1.12V
REF
CH0
TO CH7
2.7V TO 5.5V
LTC2424/LTC2428
MSB
EXR
SIG
BIT8
BIT9
BIT19 BIT18
BIT20
BIT21
BIT22
BIT23
24248 F15
= 50Hz REJECTION
= EXTERNAL OSCILLATOR
= 60Hz REJECTION
V
CC
TEST EOC
DON’T CARE
DON’T CARE
EN
D2
D1
D0
Hi-Z
Hi-Z
TEST EOC
APPLICATIO
S I
FOR
ATIO
U
W
U
U
signal is used to monitor and control the state of the
conversion cycles as well as enable the channel selection.
The multiplexer is programmed during the data output
state. The internal serial clock (SCK) generated by the ADC
is applied to the multiplexer clock input (CLK).
In order to select the internal serial clock timing mode, the
serial clock pin (SCK) must be floating (HI-Z) or pulled
HIGH prior to the falling edge of CSADC. The device will not
enter the internal serial clock mode if SCK is driven LOW
on the falling edge of CSADC. An internal weak pull-up
resistor is active on the SCK pin during the falling edge of
CSADC; therefore, the internal serial clock timing mode is
automatically selected if SCK is not externally driven.
The serial data output pin (SDO) is HI-Z as long as CSADC
is HIGH. At any time during the conversion cycle, CSADC
may be pulled LOW in order to monitor the state of the
converter. Once CSADC is pulled LOW, SCK goes LOW
and EOC is output to the SDO pin. EOC = 1 while a
conversion is in progress and EOC = 0 if the device is in the
sleep state.
Figure 14. Use of Look Ahead to Program Multiplexer After Data Output
SCK/CLK
SDO
CONVERTER
STATE
D
IN
CSADC/
CSMUX
MSB
EXR
SIG
BIT0
LSB
BIT4
BIT19BIT18
BIT20
BIT21
BIT22
BIT23
24248 F14
TEST EOC
CONV
SLEEP
DATA OUTPUT
INTERNAL CALIBRATION
66ms LOOK AHEAD
133ms CONVERSION CYCLE (OUTPUT RATE = 7.5Hz)
CONVERSION ON SELECTED CHANNEL
DON’T CARE
DON’T CARE
EN
D2
D1
D0
Hi-Z
TEST EOC
66ms CONVERT
相關(guān)PDF資料
PDF描述
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LTC2428IG 4-/8-Channel 20-Bit uPower No Latency ADCs
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LTC2442CG 24-Bit High Speed 4-Channel Delta-Sigma ADC with Integrated Amplifi er
LTC2442IG 24-Bit High Speed 4-Channel Delta-Sigma ADC with Integrated Amplifi er
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參數(shù)描述
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LTC2428CG#TR 功能描述:IC ADC 20BIT 8CH MICROPWR 28SSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 位數(shù):16 采樣率（每秒）:45k 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:2 功率耗散（最大）:315mW 電壓電源:模擬和數(shù)字 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:28-SOIC W 包裝:帶卷 (TR) 輸入數(shù)目和類型:2 個(gè)單端，單極
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