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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 133/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
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LSIFC909 Fibre Channel I/O Processor
IX-1
Index
Numerics
4 mA bidirectional signals
6-5
4 mA output signals
6-4
8 mA bidirectional signals
6-5
8 mA output signals
6-4
8b/10b decoding
2-2
8b/10b encoding
2-2
A
AC timing
6-5
ACK64/
4-3
AD[10:8]
5-1
,
5-2
AD[63:0]
4-4
ADSC/
4-10
ADV/
4-10
arbitrated loop topology
2-9
architecture
1-5
ARMEN/
4-11
B
BER
1-8
bit error rate
1-8
built-in self-test (BIST)
5-13
BWE[3:0]/
4-10
BYPASS/
4-8
C
C_BE[3:0]
5-3
C_BE[7:0]/
4-4
,
5-1
,
5-2
cache
boundary alignment
5-4
line multiple transfers
5-5
cache line size
5-13
register
5-3
register support
5-4
selection
5-4
capabilities pointer (CapPtr)
5-19
capacitance
6-3
channel protocol
2-1
class 1
2-10
class 2
2-10
class 3
2-10
class code (ClCode)
5-12
class intermix
2-10
classes of service
2-10
command descriptor block (CDB)
2-7
configuration
registers
5-7
space
5-1
context manager
1-7
controller
link
1-6
memory
1-6
CRC
2-4
cyclic redundancy check
2-4
D
data frames
2-3
,
2-4
data parity reported (DPR)
5-10
data sequence
2-7
decoding 8b/10b
2-2
destination identifier (D_ID)
2-8
detected parity error (DPE)
5-9
device ID (DevID)
5-8
DEVSEL/
4-5
DevSEL/ timing (DevSEL/Tim)
5-10
diagnostic memory enable (DME)
5-27
diagnostic write enable (DWE)
5-26
disable ARM (DisARM)
5-27
doorbell interrupt (DI)
5-28
doorbell interrupt mask (DIM)
5-29
dual address cycle (DAC)
1-6
E
EN_CDET
4-7
enable
bus mastering (EBM)
5-11
I/O space (EIOS)
5-11
memory space (EMS)
5-11
parity error response (EPER)
5-11
encode/decode
2-2
end-of-frame (EOF)
2-4
EWRAP
4-7
exchanges transfer
2-2
expansion ROM base address (ExpROMBAdd)
5-18
expansion ROM enable
5-19
F
fabric topology
2-8
FAULT/
4-8
FC
(fibre channel)
2-1
10-bit and OLC transmit timing
6-20
10-bit receive timing
6-19
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