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LatticeECP/EC and LatticeXP
Lattice Semiconductor
DDR Usage Guide
10-10
Figure 10-11. Software Primitive Implementation for Memory READ
Read Timing Waveforms
Figure 10-12 and Figure 10-13 show READ data transfer for two cases based on the results of the DQS Transition
detector logic. This circuitry decides whether or not to invert the phase of FPGA system CLK to the synchronization
registers based on the relative phases of PRMBDET and CLK.
Case 1 – If CLK = 0 on the 1st PRMBDET transition, then DDRCLKPOL = 0, hence no inversion required.
Case 2 – If CLK=1 on the 1st PRMBDET then DDRCLKPOL = 1, the system clock (CLK) needs to be
inverted before it is used for synchronization. (Figure 10-13)
The signals A, B and C illustrate the Read Cycle half clock transfer at different stages of IDDRX registers. The first
stage of the register captures data on the positive edge as shown by signal A and negative edge as shown by sig-
nal B. The data stream A goes through an additional half clock cycle transfers shown by signal C. Phase aligned
data streams B and C are presented to the next stage registers clocked by the FPGA CLK
6
DDRCLKPOL
dqs
reset
clk
uddcntl
lock
DQSDLL
DQSI
CLK
READ
DQSDEL
read
dq
DQSO
SCLK
ECLK
DDRCLKPOL
D
LSR
CE
QA
QB
RST
UDDCNTL
DQSDEL
datain_p
datain_n
DQSC
PRMBDET
LOCK
DQSBUFB
IDDRXB
ce
dqsc
prmbdet
相關PDF資料 |
PDF描述 |
|---|---|
| LFXP6C-4Q208I | IC FPGA 5.8KLUTS 142I/O 208-PQFP |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| LFXP6C-5QN208C | 功能描述:FPGA - 現(xiàn)場可編程門陣列 5.8K LUTS 142 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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| LFXP6C-5T144C | 功能描述:FPGA - 現(xiàn)場可編程門陣列 5.8K LUTs 100 IO 1.8 /2.5/3.3V -5 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP6C-5TN144C | 功能描述:FPGA - 現(xiàn)場可編程門陣列 5.8K LUTS 100 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP6E-3F256C | 功能描述:FPGA - 現(xiàn)場可編程門陣列 5.8K LUTs 188 IO 1.2 V -3 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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