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參數(shù)資料
| 型號(hào)： | LFXP20C-4FN256C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁(yè)數(shù)： | 149/397頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 19.7KLUTS 188I/O 256-BGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | XP |
| 邏輯元件/單元數(shù)： | 20000 |
| RAM 位總計(jì)： | 405504 |
| 輸入/輸出數(shù)： | 188 |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 256-BGA |
| 供應(yīng)商設(shè)備封裝： | 256-FPBGA（17x17） |
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LatticeECP/EC and LatticeXP
Lattice Semiconductor
DDR Usage Guide
10-13
DQS Postamble
At the end of a READ cycle, the DDR SDRAM device executes the READ cycle postamble and then immediately
tristates both the DQ and DQS output drivers. Since neither the memory controller (FPGA) nor the DDR SDRAM
device are driving DQ or DQS at that time, these signals float to a level determined by the off-chip termination
resistors. While these signals are floating, noise on the DQS strobe may be interpreted as a valid strobe signal by
the FPGA input buffer. This can cause the last READ data captured in the IOL input DDR registers to be overwrit-
ten before the data has been transferred to the free running resynchronization registers inside the FPGA.
Figure 10-14. Postamble Effect on READ
LatticeECP/EC and LatticeXP devices have extra dedicated logic in the in the DQS Delay Block that will prevent
this postamble problem. The DQS postamble logic is automatically implemented when the user instantiates the
This postamble solution was implemented in all the devices of the LatticeECP/EC and LatticeXP families except
the LFEC20/LFECP20 device. For this device, it is recommended that the user issue an extra READ command to
assure correct data has been transferred to the synchronization registers.
The circumstances under which the extended READ cycle is issued are given in Table 10-8.
Table 10-8. DDR Read Postamble
Current Command
Next Command
Action
Lost Cycles
Read (Row x, Bank y)
None.
None
Read (any address)
NOP
Extend the current read command.
1
3
Read (Row x, Bank y)
Read (Row n, Bank y)
Extend the current read to (Row x, Bank y) consecutive to
current command
3
Read (Row x, Bank y)
Read (Row x, Bank n)
If the Row x, Bank n was open, do nothing. Else, extend
the current read to Row x, Bank y
3
Read (any address)
Write/LMR
Extend the current read command.
3
1. Current read is extended one or more additional clock cycles.
P0
P1
N0
P0
DQ at IOL
DQS at PIN
DQ at PIN
DQS at IOL
P0
N0
N1
P1
N1
P0
N0
N1
P1
CLK at
synce reg
DATAIN_P
DATAIN_N
A
B
C
P0
N0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RMC44DRAI | CONN EDGECARD 88POS R/A .100 SLD |
| LFXP20C-3F256I | IC FPGA 19.7KLUTS 188I/O 256-BGA |
| RBB85DHBS | CONN EDGECARD 170PS R/A .050 DIP |
| AS1359-BTTT-45 | IC REG LDO 4.5V .3A TSOT23-5 |
| MIC2211-GSYML TR | IC REG LDO 1.8V/3.3V 10-MLF |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LFXP20C-4FN256I | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 19.7K LUTs 188 IO 1. 8/2.5/3.3V-4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP20C-4FN388C | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 19.7K LUTs 268 IO 1. 8/2.5/3.3V -4 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP20C-4FN388I | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 19.7K LUTs 268 IO 1. 8/2.5/3.3V-4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP20C-4FN484C | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 19.7K LUTs 340 IO 1. 8/2.5/3.3V -4 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFXP20C-4FN484I | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 19.7K LUTs 340 IO 1. 8/2.5/3.3V-4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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