參數(shù)資料
型號(hào)： LFXP15C-3FN484C
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 176/397頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 15.5KLUTS 300I/O 484-BGA
標(biāo)準(zhǔn)包裝： 60
系列： XP
邏輯元件/單元數(shù)： 15000
RAM 位總計(jì)： 331776
輸入/輸出數(shù)： 300
電源電壓： 1.71 V ~ 3.465 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
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www.latticesemi.com
11-1
tn1049_04.3
June 2007
Technical Note TN1049
2007 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other
brand or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without
notice.
Introduction
As clock distribution and clock skew management become critical factors in overall system performance, the Phase
Locked Loop (PLL) is increasing in importance for digital designers. Lattice incorporates its sysCLOCK PLL tech-
nology in the LatticeECP, LatticeEC and LatticeXP device families to help designers manage clocks within
their designs. The PLL components in the LatticeECP/EC and LatticeXP device families share the same architec-
ture. This technical note describes the features and functionalities of the PLLs and their configuration in the isp-
LEVER
design tool. Figure 11-1 shows the block diagram of the PLL.
Figure 11-1. LatticeECP/EC and LatticeXP sysCLOCK PLL Block Diagram
Features
Clock synthesis
Phase shift/duty cycle selection
Internal and external feedback
Dynamic delay adjustment
No external components required
Lock detect output
Functional Description
PLL Divider and Delay Blocks
Input Clock (CLKI) Divider
The CLKI divider is used to control the input clock frequency into the PLL block. It can be set to an integer value of
1 to 16. The divider setting directly corresponds to the divisor of the output clock. The input and output of the input
divider must be within the input and output frequency ranges specified in the device data sheet.
Feedback Loop (CLKFB) Divider
The CLKFB divider is used to divide the feedback signal. Effectively, this multiplies the output clock, because the
divided feedback must speed up to match the input frequency into the PLL block. The PLL block increases the out-
put frequency until the divided feedback frequency equals the input frequency. Like the input divider, the feedback
CLKI
Divider
CLKFB
Divider
Delay
Adjust
Phase &
Frequency
Detector
Voltage
Controlled
Oscillator
CLKOP
Divider
CLKOK
Divider
Phase/Duty
Select
Lock
Detect
Loop
Filter
RST
CLKFB
CLKI
LOCK
CLKOP
CLKOS
CLKOK
DDAOZR
DDAOLAG
DDAODEL[2:0]
DDAMODE
DDAIZR
DDAILAG
DDAIDEL[2:0]
Internal feedback from CLKOP Divider output
LatticeECP/EC and LatticeXP sysCLOCK
PLL Design and Usage Guide
相關(guān)PDF資料
PDF描述
ACM36DTAH CONN EDGECARD 72POS R/A .156 SLD
ACM36DTAD CONN EDGECARD 72POS R/A .156 SLD
ACM43DRSS CONN EDGECARD 86POS DIP .156 SLD
EMC65DREN-S734 CONN EDGECARD 130POS .100 EYELET
HA4201CBZ96 IC SWITCH CROSS VIDEO 1:1 8SOIC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
LFXP15C-3FN484I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 15.4K LUTs 1.8/2.5/3 .3V-3 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15C-4F256C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 15.4K LUTs 188 IO 1. 8/2.5/3.3V -4 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15C-4F256I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 15.4K LUTs 188 IO 1. 8/2.5/3.3V -4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15C-4F388C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 15.4K LUTs 268 IO 1. 8/2.5/3.3V -4 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP15C-4F388I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 15.4K LUTs 268 IO 1. 8/2.5/3.3V -4 Spd I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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