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參數(shù)資料
| 型號(hào)： | LFECP33E-4FN672I |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 116/163頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 32.8KLUTS 672FPBGA |
| 產(chǎn)品培訓(xùn)模塊： | LatticeECP3 Introduction |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | ECP |
| 邏輯元件/單元數(shù)： | 32800 |
| RAM 位總計(jì)： | 434176 |
| 輸入/輸出數(shù)： | 496 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 672-BBGA |
| 供應(yīng)商設(shè)備封裝： | 672-FPBGA（27x27） |
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3-20
DC and Switching Characteristics
LatticeECP/EC Family Data Sheet
Figure 3-10. Read Before Write (SP Read/Write on Port A, Input Registers Only)
Note: Input data and address are registered at the positive edge of the clock and output data appears after the positive edge of the clock.
Figure 3-11. Write Through (SP Read/Write On Port A, Input Registers Only)
Note: Input data and address are registered at the positive edge of the clock and output data appears after the positive edge of the clock.
A0
A1
A0
A1
D0
D1
D2
DOA
A0
D2
D3
D1
old A0 Data
old A1 Data
D0
D1
DIA
ADA
WEA
CSA
CLKA
tSU tH
tACCESS
A0
A1
A0
D0
D1
D4
tSU
tACCESS
tH
D2
D3
D4
D0
D1
D2
Data from Prev Read
or Write
Three consecutive writes to A0
D3
DOA
DIA
ADA
WEA
CSA
CLKA
tACCESS
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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