參數(shù)資料
型號(hào): L80225
英文描述: L80225 10/100 MbpsTX/10BT Ethernet Physical Layer Device (PHY) technical manual 4/02
中文描述: L80225 10/100 MbpsTX/10BT以太網(wǎng)物理層器件(PHY)技術(shù)手冊(cè)4月2日
文件頁(yè)數(shù): 74/192頁(yè)
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代理商: L80225
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Draft 6/5/00
3-4
Signal Descriptions
Copyright 2000 by LSI Logic Corporation. All rights reserved.
3.2 Controller Interface Signals (MII)
CRS
Carrier Sense Output
The CRS output is asserted HIGH when valid data is
detected on the receive TP inputs. CRS is clocked out on
the falling edge of RX_CLK.
O
OSCIN
Clock Oscillator Input
There must be either a 25 MHz crystal between this pin
and GND or a 25 MHz clock applied to this pin. TX_CLK
output is generated from this input.
I
RX_CLK
Receive Clock Output
Receive data on RXD, RX_DV, and RX_ER is clocked out
to an external controller on the falling edge of RX_CLK.
O
RXD[3:0]
Receive Data Output
RXD[3:0] contain receive nibble data from the TP input,
and they are clocked out on the falling edge of RX_CLK.
O
RX_DV
Receive Data Valid Output
RX_DV is asserted HIGH when valid decoded data is
present on the RXD outputs. RX_DV is clocked out on the
falling edge of RX_CLK.
O
RX_EN/JAMn Receive Enable Input
The function of this pin is configured through the R/J
Configuration Select bit (R/J_CFG) in the MI serial port
Configuration 1 register. When R/J_CFG is set, the pin is
configured as JAMn; when it is cleared, the pin functions
as RX_EN
I
RX_EN function: when RX_EN is HIGH, all of the receive
outputs (RX_CLK, RXD[3:0], RX_DV, RX_ER, COL) are
enabled. When RX_EN is LOW, the outputs are in a
high-impedance state.
JAMn function: when JAMn is HIGH, a JAM packet is
transmitted when receive activity is detected. When
JAMn is LOW, no JAM packet is transmitted.
RXER/RXD4
Receive Error Output/Fifth Receive Data Output
The RXER/RXD4 output is asserted HIGH when a coding
error or other specified errors are detected on the receive
O
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