參數(shù)資料
        型號: KMPC8541EVTAQF
        廠商: Freescale Semiconductor
        文件頁數(shù): 80/88頁
        文件大?。?/td> 0K
        描述: IC MPU POWERQUICC III 783-FCPBGA
        標(biāo)準(zhǔn)包裝: 1
        系列: MPC85xx
        處理器類型: 32-位 MPC85xx PowerQUICC III
        速度: 1.0GHz
        電壓: 1.3V
        安裝類型: 表面貼裝
        封裝/外殼: 783-BBGA,F(xiàn)CBGA
        供應(yīng)商設(shè)備封裝: 783-FCPBGA(29x29)
        包裝: 托盤
        MPC8541E PowerQUICC III Integrated Communications Processor Hardware Specification, Rev. 4.2
        Freescale Semiconductor
        81
        System Design Information
        17.8.1 Termination of Unused Signals
        If the JTAG interface and COP header are not used, Freescale recommends the following connections:
        TRST should be tied to HRESET through a 0 k
        Ω isolation resistor so that it is asserted when the
        system reset signal (HRESET) is asserted, ensuring that the JTAG scan chain is initialized during
        the power-on reset flow. Freescale recommends that the COP header be designed into the system
        as shown in Figure 52. If this is not possible, the isolation resistor allows future access to TRST in
        case a JTAG interface may need to be wired onto the system in future debug situations.
        Tie TCK to OVDD through a 10 kΩ resistor. This prevents TCK from changing state and reading
        incorrect data into the device.
        No connection is required for TDI, TMS, or TDO.
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