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參數(shù)資料
| 型號： | KMPC852TZT100A |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 49/80頁 |
| 文件大小： | 0K |
| 描述： | IC MPU PWRQUICC 100MHZ 256PBGA |
| 標準包裝： | 2 |
| 系列： | MPC8xx |
| 處理器類型： | 32-位 MPC8xx PowerQUICC |
| 速度： | 100MHz |
| 電壓： | 1.8V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應商設(shè)備封裝： | 256-PBGA（23x23） |
| 包裝： | 托盤 |
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MPC852T PowerQUICC Hardware Specifications, Rev. 4
Freescale Semiconductor
53
CPM Electrical Characteristics
Figure 52. Ethernet Transmit Timing Diagram
Figure 53. CAM Interface Receive Start Timing Diagram
Figure 54. CAM Interface REJECT Timing Diagram
TCLK3
128
TxD3
(Output)
128
TENA(RTS3)
(Input)
Notes:
Transmit clock invert (TCI) bit in GSMR is set.
If RENA is deasserted before TENA, or RENA is not asserted at all during transmit, the CSL bit is set in the
buffer descriptor at the end of the frame transmission.
1.
2.
RENA(CD3)
(Input)
133
134
132
131
121
129
(Note 2)
RCLK3
RxD3
(Input)
RSTRT
(Output)
0
136
125
1
BIT1
BIT2
Start Frame De-
REJECT
137
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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