參數(shù)資料
型號: KMC8113TVT3600V
廠商: Freescale Semiconductor
文件頁數(shù): 29/44頁
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描述: IC DSP 300/400MHZ 431FCPGA
標準包裝: 2
系列: StarCore
類型: SC140 內(nèi)核
接口: 以太網(wǎng),I²C,TDM,UART
時鐘速率: 300MHz
非易失內(nèi)存: 外部
芯片上RAM: 1.436MB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.10V
工作溫度: -40°C ~ 105°C
安裝類型: 表面貼裝
封裝/外殼: 431-BFBGA,F(xiàn)CBGA
供應商設備封裝: 431-FCPBGA(20x20)
包裝: 托盤
MSC8113 Tri-Core Digital Signal Processor Data Sheet, Rev. 1
Freescale Semiconductor
35
2.5.10.4
SMII Mode
2.5.11
GPIO Timing
Table 27. SMII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
808
ETHSYNC_IN, ETHRXD to ETHCLOCK rising edge set-up time
1.0
ns
809
ETHCLOCK rising edge to ETHSYNC_IN, ETHRXD hold time
1.0
ns
810
ETHCLOCK rising edge to ETHSYNC, ETHTXD output delay
1.51
6.02
ns
Notes:
1.
Measured using a 5 pF load.
2.
Measured using a 15 pF load.
Figure 26. SMII Mode Signal Timing
Table 28. GPIO Timing
No.
Characteristics
Ref = CLKIN
Unit
Min
Max
601
REFCLK edge to GPIO out valid (GPIO out delay time)
6.1
ns
602
REFCLK edge to GPIO out not valid (GPIO out hold time)
1.1
ns
603
REFCLK edge to high impedance on GPIO out
5.4
ns
604
GPIO in valid to REFCLK edge (GPIO in set-up time)
3.5
ns
605
REFCLK edge to GPIO in not valid (GPIO in hold time)
0.5
ns
Figure 27. GPIO Timing
Valid
ETHCLOCK
ETHSYNC_IN
ETHRXD
ETHSYNC
ETHTXD
Valid
810
809
808
REFCLK
GPIO
(Output)
GPIO
(Input)
Valid
603
High Impedance
604
605
602
601
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PDF描述
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TAJC477M004RNJ CAP TANT 470UF 4V 20% 2312
KMC8112TVT2400V IC DSP 300MHZ 431FCPBGA
GEC10DREH-S734 CONN EDGECARD 20POS .100 EYELET
KMC8112TMP2400V IC DSP 300MHZ 431FCPBGA
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參數(shù)描述
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