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參數(shù)資料
| 型號(hào)： | KB2502 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | VIDEO AMP MERGED OSD PROCESSOR |
| 中文描述： | 視頻放大器合并OSD處理器 |
| 文件頁數(shù)： | 33/62頁 |
| 文件大小： | 724K |
| 代理商： | KB2502 |
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KB2502 VIDEO AMP MERGED OSD PROCESSOR FOR MONITORS
32
Preliminary
V-AMP Control
Registers - 11
(Row 15,
Column 14)
CS2 ~ CS1
(bit1 ~ bit0)
Cut-off offset current control
BPW2 ~ BPW1
(bit4 ~ bit3)
Generated clamp pulse width control
To carry out this function, set the CLPS bit to " 0 "
Polarity of horizontral fly back signal
If this bit is ’0’ HFLB’s polarity is negative, and if ’1’ it is positive.
Polarity of clamp pulse signal
If this bit is ’0’ CLP’s polarity is positive, and if ’1’ it is negative.
This bit has meaning only if the CLPS bit is set to ’1’
Clamp pulse generation enable
If this bit is ’0’ clamp signal is made using the HFLB signal, so there is
no need to supply the clamp signal.
and if ’1’you must supply external clamp signal.
HS9 ~ HS7 bits select OSD raster color 3 to be half tone.
To carry out half tone function, set the HT bit to " 1 ".
BLKP
(bit 5)
CLPP
(bit 6)
CLPS
(bit 7)
V-AMP Control
Registers - 12
(Row 15,
Column 15)
HS9 ~ HS7
(bit2 ~ bit 0)
Tabel 4. Register Description (Continued)
Registers
Bits
Description
CS2
0
0
1
1
CS1
0
1
0
1
Cut-off Offset Current
0
50
μ
A
100
μ
A
150
μ
A
POR
O
BPW2
0
0
1
1
BPW1
0
1
0
1
Width
0.33
μ
s
0.66
μ
s
1.00
μ
s
1.33
μ
s
POR
O
HS9
HS8
HS7
OSD
R
0
0
1
1
0
0
1
1
Raster
Color 3
POR
G
0
0
0
0
1
1
1
1
B
0
1
0
1
0
1
0
1
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
Black
Blue
Red
Magenta
Green
Cyan
Yellow
White
O
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| KB2511B | ACB 14C 14#16 PIN RECP BOX |
| KB2512 | DEFLECTION PROCESSOR FOR MULTISYNC MONITORS |
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| KB2516 | TRIPLE 8-BIT ANALOG-TO-DIGITAL CONVERTER |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| KB2511B | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:DEFLECTION PROCESSOR FOR MULTISYNC MONITORS |
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