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參數(shù)資料
| 型號(hào)： | ispLSI1016 |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | In-System Programmable High Density PLD |
| 中文描述： | 在系統(tǒng)可編程高密度可編程邏輯器件 |
| 文件頁(yè)數(shù)： | 8/13頁(yè) |
| 文件大?。?/td> | 162K |
| 代理商： | ISPLSI1016 |
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8
Specifications
ispLSI 1016EA
Internal Timing Parameters
1
t
ob
t
sl
1. Internal Timing Parameters are not tested and are for reference only.
Table 2-0037A/1016EA
v.2.6
Outputs
UNITS
DESCRIPTION
#
PARAM.
49 Output Buffer Delay
50 Output Buffer Delay, Slew Limited Adder
ns
ns
t
oen
t
odis
t
goe
51 I/O Cell OE to Output Enabled
52 I/O Cell OE to Output Disabled
53 Global OE
ns
ns
ns
t
gy0
t
gy1
t
gcp
t
ioy1
t
iocp
54 Clock Delay, Y0 to Global GLB Clock Line (Ref. clk)
ns
Global Reset
t
gr
Clocks
59 Global Reset to GLB and I/O Registers
ns
55 Clock Delay, Y1 to Global GLB Clock Line
56 Clock Delay, Clock GLB to Global GLB Clock Line
57 Clock Delay, Y1 to I/O Cell Global Clock Line
58 Clock Delay, Clock GLB to I/O Cell Global Clock Line
ns
ns
ns
ns
MIN. MAX.
-200
—
—
—
—
—
0.9
0.9
0.8
0.0
0.8
0.9
5.0
3.1
3.1
1.4
0.9
0.0
0.9
1.8
0.0
2.8
-100
MIN.
MIN.
MAX.
MAX.
-125
—
—
—
—
—
1.1
0.9
0.8
0.0
0.8
—
—
2.0
5.0
5.1
5.1
3.9
1.9
1.5
1.8
0.0
2.8
5.1
—
—
—
—
—
1.9
1.5
0.8
0.0
0.8
—
1.7
5.0
4.0
4.0
3.0
1.1
0.9
1.8
0.0
2.8
2.1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ISPLSI1016E | In-System Programmable High Density PLD |
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參數(shù)描述 |
|---|---|
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| ISPLSI1016-125LT | 制造商:Lattice Semiconductor Corporation 功能描述: |
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| ispLSI1016-60LJI | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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