Specifications ispLSI 5384VE 17 ispLSI 5384VE Timing Model tBLA t
參數(shù)資料
型號： ISPLSI 5384VE-80LB272I
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 9/22頁
文件大?。?/td> 0K
描述： IC PLD ISP 192I/O 12NS 272BGA
標準包裝： 40
系列： ispLSI® 5000VE
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 12.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 12
宏單元數(shù)： 384
門數(shù)： 18000
輸入/輸出數(shù)： 192
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 272-BBGA
供應(yīng)商設(shè)備封裝： 272-BGA（27x27）
包裝： 托盤
其它名稱： ISPLSI5384VE-80LB272I
Specifications ispLSI 5384VE
17
ispLSI 5384VE Timing Model
tBLA
tLP
tIOI
tBSR
tPTSR
tGPTOE
tPTOE
tPDi
tGOE
tRST
tIN
tINREG
tROUTE
tPDb
tFBK
tBUF
tIOO
tEN
tDIS
tPTSA
tPTCLK
tBCLK
tGCLK_IN
IN
Q
OE
From Feedback
In/Out
Delays
In/Out
Delays
Routing/
GLB Delays
Register/
Latch Delays
Control
Delays
Feedback
OUT
DATA
MC Reg
CE
S/R
CLK
RST
Note: Italicized parameters are delay adders above and beyond default conditions (i.e. GRP load of one GLB, CLK0, high-speed AND Array
and VCC I/O option).
5000VE Timing Model
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PDF描述
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ISPLSI 5384VE-100LF256 IC PLD ISP 192I/O 10NS 256FPBGA
TAJR334K035RNJ CAP TANT 0.33UF 35V 10% 0805
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參數(shù)描述
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