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參數(shù)資料
| 型號(hào)： | ISPLSI 5384VA-70LB208 |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁(yè)數(shù)： | 7/31頁(yè) |
| 文件大小： | 0K |
| 描述： | IC PLD ISP 288I/O 15NS 208FPBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | ispLSI® 5000VA |
| 可編程類(lèi)型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 15.0ns |
| 電壓電源 - 內(nèi)部： | 3 V ~ 3.6 V |
| 邏輯元件/邏輯塊數(shù)目： | 12 |
| 宏單元數(shù)： | 384 |
| 門(mén)數(shù)： | 18000 |
| 輸入/輸出數(shù)： | 144 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 208-BGA |
| 供應(yīng)商設(shè)備封裝： | 208-FPBGA（17x17） |
| 包裝： | 托盤(pán) |
| 其它名稱： | ISPLSI5384VA-70LB208 |
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Specifications ispLSI 5384VA
15
ispLSI 5384VA Timing Model
PT Controls
Register
Dedicated
Input Buffers
Output
Buffer
I/O
Pad
I/O
Pad
INPUT
OUTPUT
PTSA
GRP
tgrpi
GLB/Macrocell
tandhs
tgoe
tgclk01
tgrst
ttoe
tandlp
t5ptcom
t5ptreg
t5ptxreg
t5ptxcom
tptsacom
tptsareg
tsck
tpck
tptsacken
tsrst
tpoe
tgpoe
tidcom
tgrpm
t
Slew
Input
Pad
tprst
tidreg
Buffer Delays
AND Array
tgclken1
tgclken0
Input
Buffer
#22
#23
#58
#40
#41
#42
#46
#44
#45
#47
#43
#51
#48
#31
tmbp
#39
tftog
todcom
#24
tslf
tsls
#27
#28
tslsd
tslfd
#30
#29
todreg
#25
todz
#26
#32
tmlat
#34
tmsu
#35
tmh
#33
tmco
#37
tmhce
#36
tmsuce
#38
tmrst
#52
#49
#50
#53
#54
#55
#56
#59
tgclk23
#60
#61
#62
#63
#64
#65
#57
pcken
scken
Internal Timing Parameters1
Over Recommended Operating Conditions
GRP
tgrpi
57
GRP Delay from I/O Pad
–
1.5
–2–3
ns
tgrpm
58
GRP Delay from Macrocell
–
1.0
–
1.2
–
1.2
ns
Global Control Delays
tgclk01
59
Global Clock 0 or 1 Delay
–
1.2
–
1.7
–
2.4
ns
tgclk23
60
Global Clock 2 or 3 Delay
–
2.2
–
2.7
–
4.4
ns
tgclken0
61
Global CLKEN 0 Delay
–
1.7
–
2.4
–
3.4
ns
tgclken1
62
Global CLKEN 1 Delay
–
2.7
–
3.4
–
5.4
ns
tgrst
63
Global Set/Reset Delay
–
12.2
–
15.8
–
23.4
ns
tgoe
64
Global OE Delay
–
4.7
–
6.3
–
9.4
ns
ttoe
65
Test OE Delay
–
4.7
–
6.2
–
9.4
ns
-125
-100
-70
MIN
MAX
MIN
MAX
MIN
MAX
UNIT
PARAM
#
DESCRIPTION
1. Internal Timing Parameters are not tested and are for reference only.
Timing Rev 4.0
Refer to Timing Model in this data sheet for further details.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EEC10DRXS | CONN EDGECARD 20POS DIP .100 SLD |
| DEA1X3A121JA2B | CAP CER 120PF 1KV 5% RADIAL |
| MIC5219-2.85BMM | IC REG LDO 2.85V .5A 8-MSOP |
| RW2-2412S/H2/B | CONV DC/DC 2W 18-36VIN 12VOUT |
| RW2-2409S/H2/B | CONV DC/DC 2W 18-36VIN 09VOUT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ISPLSI5384VA-70LB208 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類(lèi)型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5384VA-70LB272 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類(lèi)型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5384VA-70LB272I | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類(lèi)型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5384VA-70LB388 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類(lèi)型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5384VA-70LB388I | 制造商:Lattice Semiconductor Corporation 功能描述: |
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