Specifications ispLSI 5128VE 5 Figure 3. ispLSI 5000VE Generic Logic Block (GLB) 0 12 66 67 Macrocell 0 PT 160 Macrocell 1 Macrocell 15 Macroce" />
參數(shù)資料
型號(hào)： ISPLSI 5128VE-125LT128
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 17/21頁(yè)
文件大小： 0K
描述： IC PLD ISP 96I/O 7.5NS 128TQFP
標(biāo)準(zhǔn)包裝： 90
系列： ispLSI® 5000VE
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 7.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 4
宏單元數(shù)： 128
門數(shù)： 6000
輸入/輸出數(shù)： 96
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-TQFP（14x14）
包裝： 托盤
其它名稱： ISPLSI5128VE-125LT128
Specifications ispLSI 5128VE
5
Figure 3. ispLSI 5000VE Generic Logic Block (GLB)
0 12
66 67
Macrocell 0
PT 160
Macrocell 1
Macrocell 15
Macrocell 31
PT 9
PT 8
PT 7
PT 6
PT 5
PT 0
PT 1
PT 2
PT 3
PT 4
PT 79
PT 78
PT 77
PT 76
PT 75
PT 159
PT 158
PT 157
PT 156
PT 155
Shared PT Clock
Global PTOE 0 ... 3
4
Shared PT Clock
Global PTOE 0 ... 3
4
Shared PT Clock
Global PTOE 0 ... 3
4
To I/O Pad
Shared PT Clock
Global PTOE 0 ... 3
4
From GRP
PTSA
Global PTOE Bus
From PTSA
PT 161
PT 162
Shared PT Reset
PTSA bypass
PT Clock
PT Preset
PT Reset
PTOE
PTSA bypass
PT Clock
PT Preset
PT Reset
PTOE
PTSA bypass
PT Clock
PT Preset
PT Reset
PTOE
PTSA bypass
PT Clock
PT Preset
PT Reset
PTOE
To GRP
To I/O Pad
To GRP
To I/O Pad
To GRP
To I/O Pad
To GRP
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PDF描述
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參數(shù)描述
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