Specifications ispLSI 1016E USE ispLSI 1016EA FOR NEW DESIGNS Internal Timing Parameters1
參數(shù)資料
型號： ISPLSI 1016E-80LJN
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 10/13頁
文件大小： 0K
描述： IC PLD ISP 32I/O 80MHZ 44PLCC
標準包裝： 26
系列： ispLSI® 1000E
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 16
門數(shù)： 2000
輸入/輸出數(shù)： 32
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設(shè)備封裝： 44-PLCC（16.58x16.58）
包裝： 管件
其它名稱： 220-1586-5
ISPLSI 1016E-80LJN-ND
ISPLSI1016E-80LJN
6
Specifications ispLSI 1016E
USE
ispLSI
1016EA
FOR
NEW
DESIGNS
Internal Timing Parameters1
tiobp
1. Internal Timing Parameters are not tested and are for reference only.
2. Refer to Timing Model in this data sheet for further details.
3. The XOR Adjacent path can only be used by Lattice hard macros.
Table 2-0036-16/125,100, 80
Inputs
UNITS
-125
MIN.
-100
MIN.
MAX.
DESCRIPTION
#
2
PARAMETER
22 I/O Register Bypass
–
0.4
ns
tiolat
23 I/O Latch Delay
–
2.4
ns
tgrp1
29 GRP Delay, 1 GLB Load
–
1.9
ns
GLB
t1ptxor
36 1 Product Term/XOR Path Delay
––
6.1
ns
t20ptxor
37 20 Product Term/XOR Path Delay
––
6.1
ns
txoradj
38 XOR Adjacent Path Delay
––
6.6
ns
tgbp
39 GLB Register Bypass Delay
––
1.6
ns
tgsu
40 GLB Register Setup Time before Clock
–
0.2
–
ns
tgh
41 GLB Register Hold Time after Clock
–
2.5
–
ns
tgco
42 GLB Register Clock to Output Delay
–
1.9
ns
3
tgro
43 GLB Register Reset to Output Delay
–
6.3
ns
tptre
44 GLB Product Term Reset to Register Delay
–
5.1
ns
tptoe
45 GLB Product Term Output Enable to I/O Cell Delay
–
7.1
ns
tptck
46 GLB Product Term Clock Delay
4.8
5.3
ns
ORP
0.3
1.8
GRP
1.8
t4ptbpc
34 4 Product Term Bypass Path Delay (Combinatorial)
––
5.7
ns
4.4
1.0
3.9
t4ptbpr
35 4 Product Term Bypass Path Delay (Registered)
––
5.6
ns
3.9
0.2
1.5
1.8
4.4
3.5
5.5
3.2
3.5
torp
47 ORP Delay
–
1.0
ns
torpbp
48 ORP Bypass Delay
–
0.0
ns
1.0
0.0
tiosu
24 I/O Register Setup Time before Clock
3.0
3.5
–
ns
–
tioh
25 I/O Register Hold Time after Clock
-0.3
-0.4
–
ns
–
tioco
26 I/O Register Clock to Out Delay
–
5.0
ns
4.0
tior
27 I/O Register Reset to Out Delay
–
5.0
ns
4.0
tdin
28 Dedicated Input Delay
–
2.6
ns
2.2
-80
MIN. MAX.
–
0.6
3.6
4.5
-0.6
7.5
3.9
2.9
7.1
8.2
8.3
1.9
8.1
7.3
-0.6
4.3
2.9
7.0
7.2
9.7
6.8
7.5
1.5
0.0
tgrp16
32 GRP Delay, 16 GLB Loads
––
3.1
ns
tgrp4
30 GRP Delay, 4 GLB Loads
––
2.2
ns
2.4
1.9
tgrp8
31 GRP Delay, 8 GLB Loads
––
2.5
ns
2.1
–
4.7
3.3
3.8
相關(guān)PDF資料
PDF描述
R12P212S/X2/R6.4 CONV DC/DC 2W 12VIN 12VOUT
M4A5-32/32-10VNI IC CPLD 32MACRO 44TQFP
LTC4222CG#TRPBF IC CTRLR DUAL HOT SWAP 36-SSOP
TRJB106M020RRJ CAP TANT 10UF 20V 20% 1210
M4A5-32/32-7VNC IC CPLD 32MACRO 44TQFP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ispLSI1016E-80LJN 功能描述:CPLD - 復雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI1016E80LJNI 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable High Density PLD
ispLSI1016E-80LJNI 功能描述:CPLD - 復雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ispLSI1016E-80LT 制造商:Lattice Semiconductor Corporation 功能描述:EE PLD, 18.5 ns, 44 Pin Plastic QFP
ISPLSI1016E80LT44 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable High Density PLD
發(fā)布緊急采購，3分鐘左右您將得到回復。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*