Specifications ispLSI 1016 8 Internal Timing Parameters1 ns Outputs t
參數(shù)資料
型號: ISPLSI 1016-60LT44
廠商: Lattice Semiconductor Corporation
文件頁數(shù): 17/17頁
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描述: IC PLD ISP 32I/O 20NS 44TQFP
標(biāo)準包裝: 160
系列: ispLSI® 1000
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1): 20.0ns
電壓電源 - 內(nèi)部: 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目: 16
門數(shù): 2000
輸入/輸出數(shù): 32
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 44-TQFP
供應(yīng)商設(shè)備封裝: 44-TQFP(10x10)
包裝: 托盤
其它名稱: ISPLSI1016-60LT44
Specifications ispLSI 1016
8
Internal Timing Parameters1
ns
Outputs
tob
toen
todis
Clocks
tgy0
tgy1/2
tgcp
tioy1/2
tiocp
Global Reset
tgr
47
48
49
50
51
52
53
54
55
Output Buffer Delay
I/O Cell OE to Output Enabled
I/O Cell OE to Output Disabled
Clock Delay, Y0 to Global GLB Clock Line (Ref. clock)
Clock Delay, Y1 or Y2 to Global GLB Clock Line
Clock Delay, Clock GLB to Global GLB Clock Line
Clock Delay, Y1 or Y2 to I/O Cell Global Clock Line
Clock Delay, Clock GLB to I/O Cell Global Clock Line
Global Reset to GLB and I/O Registers
MIN. MAX.
DESCRIPTION
PARAMETER
UNITS
-90
#
2
2.9
2.1
0.8
2.1
0.8
MIN. MAX.
-110
1. Internal Timing Parameters are not tested and are for reference only.
2. Refer to Timing Model in this data sheet for further details.
2.1
3.3
2.9
3.8
4.2
3.8
4.2
7.9
3.5
2.5
1.0
2.5
1.0
2.5
4.0
3.5
4.5
5.0
4.5
5.0
7.5
ALL
DEVICES
DISCONTINUED
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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