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參數(shù)資料
| 型號(hào)： | ISPLSI 1016-110LJ |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 4/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLD ISP 32I/O 10NS 44PLCC |
| 標(biāo)準(zhǔn)包裝： | 26 |
| 系列： | ispLSI® 1000 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 10.0ns |
| 電壓電源 - 內(nèi)部： | 4.75 V ~ 5.25 V |
| 邏輯元件/邏輯塊數(shù)目： | 16 |
| 門數(shù)： | 2000 |
| 輸入/輸出數(shù)： | 32 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 44-PLCC（16.58x16.58） |
| 包裝： | 管件 |
| 其它名稱： | ISPLSI1016-110LJ |
Specifications ispLSI 1016
11
ispLSI 1016 Timing Model
GLB Reg
Delay
I/O Pin
(Output)
ORP
Delay
Feedback
4 PT Bypass
20 PT
XOR Delays
Control
PTs
GRP
Loading
Delay
Input
Register
Clock
Distribution
I/O Pin
(Input)
Y0
Y1,2
D
Q
GRP 4
GLB Reg Bypass
ORP Bypass
DQ
RST
RE
OE
CK
I/O Reg Bypass
I/O Cell
ORP
GLB
GRP
I/O Cell
#21 - 25
#27, 29,
30, 31, 32
#28
#33
#34, 35, 36
#51, 52,
53, 54
#42, 43,
44
#50
#45
#46
Reset
Ded. In
#26
#20
RST
#55
#37
#38, 39,
40, 41
#48, 49
#47
Derivations of
tsu, th and tco from the Product Term Clock1
tsu
= Logic + Reg su - Clock (min)
=
(tiobp + tgrp4 + t20ptxor) + (tgsu) - (tiobp + tgrp4 + tptck(min))
=
(#20 + #28 + #35) + (#38) - (#20 + #28 + #44)
5.5 ns = (1.0 + 1.0 + 8.0) + (1.0) - (1.0 + 1.0 + 3.5)
th
= Clock (max) + Reg h - Logic
=
(tiobp + tgrp4 + tptck(max)) + (tgh) - (tiobp + tgrp4 + t20ptxor)
=
(#20 + #28 + #44) + (#39) - (#20 + #28 + #35)
3.0 ns = (1.0 + 1.0 + 7.5) + (3.5) - (1.0 + 1.0 + 8.0)
tco
= Clock (max) + Reg co + Output
=
(tiobp + tgrp4 + tptck(max)) + (tgco) + (torp + tob)
=
(#20 + #28 + #44) + (#40) + (#45 + #47)
16.0 ns = (1.0+ 1.0 +7.5) + (1.5) + (2.5 + 2.5)
Derivations of
tsu, th and tco from the Clock GLB1
tsu
= Logic + Reg su - Clock (min)
=
(tiobp + tgrp4 + t20ptxor) + (tgsu) - (tgy0(min) + tgco + tgcp(min))
=
(#20 + #28 + #35) + (#38) - (#50 + #40 + #52)
5.0 ns = (1.0 + 1.0 + 8.0) + (1.0) - (3.5 + 1.5 + 1.0)
th
= Clock (max) + Reg h - Logic
=
(tgy0(max) + tgco + tgcp(max)) + (tgh) - (tiobp + tgrp4 + t20ptxor)
=
(#50 + #40 + #52) + (#39) - (#20 + #28 + #35)
3.5 ns = (3.5 + 1.5 + 5.0) + (3.5) - (1.0 + 1.0 + 8.0)
tco
= Clock (max) + Reg co + Output
=
(tgy0(max) + tgco + tgcp(max)) + (tgco) + (torp + tob)
=
(#50 + #40 + #52) + (#40) + (#45 + #47)
16.5 ns = (3.5 + 1.5 + 5.0) + (1.5) + (2.5 + 2.5)
1. Calculations are based upon timing specifications for the ispLSI 1016-90.
ALL
DEVICES
DISCONTINUED
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ISPLSI1016-125LT | 制造商:Lattice Semiconductor Corporation 功能描述: |
| ISPLSI1016-50LJ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Electrically-Erasable Complex PLD |
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| ispLSI1016-60LJI | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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