23 FN7911.2 April 25, 2013 TABLE 4. JESD204 CONFIGURATIONS AND CLOCK FREQUENCIES ADC SAMPLE CLOCK RANGE (MHz) LANE DATA RATE MULTIPLIE" />
參數(shù)資料
型號： ISLA224S25IR1Z
廠商： Intersil
文件頁數(shù)： 16/38頁
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描述： IC ADC
標(biāo)準(zhǔn)包裝： 1
系列： *
ISLA224S
23
FN7911.2
April 25, 2013
TABLE 4. JESD204 CONFIGURATIONS AND CLOCK FREQUENCIES
ADC SAMPLE CLOCK RANGE (MHz)
LANE DATA RATE MULTIPLIER FROM ADC SAMPLE CLOCK
RATE
LANE DATA RATE (GBPS)
100-250 (Efficient Packing) 3 Lanes
(14-bits)*(2 ADC channels)*(10/8 encoder overhead)/(3
lanes) = (280/24) = 11.6667
1.16667 to 2.916675
57-250 (Efficient Packing) 2 Lanes
(14-bits)*(2 ADC channels)*(10/8 encoder overhead)/(2
lanes) = (280/16) = 17.5
1.00 to 4.375
50-219(Simple Packing) 2 Lanes
(14-bits+2-bit tail)*(2 ADC channels)*(10/8 encoder
overhead)/(2 lanes) = (320/16) = 20
1.00 to 4.375
TABLE 5. JESD204 PARAMETERS
PACKING
MODE
NUMBER
OF LANES
JESD204
PARAMETER ENCODED
JESD204 PARAMETERS AND FRAME MAP (Notes 16, 17, 18)
Efficient
3
CF = 0
0
CS = 0
0
C0S0[13:6] C0S0[5:0]
C0S1[11:4] C0S1[3:0]
C0S2[9:2] C0S2[1:0]
C0S3[7:0]
F = 7
6
C0S1[13:12]
C0S2[13:10]
C0S3[13:8]
HD = 0
0
L = 3
2
C0S4[13:6] C0S4[5:0]
C0S5[11:4] C0S5[3:0]
C1S0[9:2] C1S0[1:0]
C1S1[7:0]
M = 2
1
C0S5[13:12]
C1S0[13:10]
C1S1[13:8]
N = 14
13
N' = 14
13
C1S2[13:6] C1S2[5:0]
C1S3[11:4] C1S3[3:0]
C1S4[9:2] C1S4[1:0]
C1S5[7:0]
S = 6
5
C1S3[13:12]
C1S4[13:10]
C1S5[13:8]
K >= 3
>= 2
Efficient
2
CF = 0
0
CS = 0
0
C0S0[13:6] C0S0[5:0]
C0S1[11:4] C0S1[3:0]
C0S2[9:2] C0S2[1:0]
C0S3[7:0]
F = 7
6
C0S1[13:12]
C0S2[13:10]
C0S3[13:8]
HD = 0
0
L = 2
1
C1S0[13:6] C1S0[5:0]
C1S1[11:4] C1S1[3:0]
C1S2[9:2] C1S2[1:0]
C1S3[7:0]
M = 2
1
C1S1[13:12]
C1S2[13:10]
C1S3[13:8]
N = 14
13
N' = 14
13
S = 4
3
K >= 3
>=2
Simple
2
CF = 0
0
CS = 0
0
C0S0[13:6] C0S0[5:0]
F = 2
1
TT
HD = 0
0
L = 2
1
C1S0[13:6] C1S0[5:0]
M = 2
1
TT
N = 14
13
N' = 16
15
S = 1
0
K >= 9
>= 8
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PDF描述
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