FN7510.0 February 14, 2008 I2C Timing Diagram Seri" />
參數(shù)資料
型號： ISL59450IQZ
廠商： Intersil
文件頁數(shù)： 33/37頁
文件大?。?/td> 0K
描述： IC SWITCH VID CRSSPNT 128-MQFP
標準包裝： 66
系列： *
5
FN7510.0
February 14, 2008
I2C
Timing Diagram
Serial Interface (I2C) Specifications
SYMBOL
PARAMETER
CONDITIONS
MIN
(Note 1)
TYP
MAX
(Note 1)
UNIT
VOL
SDA Output Buffer LOW Voltage
IOL =4mA
0
0.4
V
ILI
Input Leakage Current on SCL
VIN = 5.5V
0.1
1
A
ILO
I/O Leakage Current on SDA
VIN = 5.5V
0.1
1
A
TIMING CHARACTERISTICS
fSCL
SCL Frequency
400
kHz
tLOW
Clock LOW Time
Measured at the 30% of VD crossing.
1.3
s
tHIGH
Clock HIGH Time
Measured at the 70% of VD crossing.
0
0.9
s
tSU:STA
START Condition Set-up Time
SCL rising edge to SDA falling edge. Both
crossing 70% of VD.
0.6
s
tHD:STA
START Condition Hold Time
From SDA falling edge crossing 30% of VD
to SCL falling edge crossing 70% of VD.
0.6
s
tHD:DAT
Input Data Hold Time
From SCL falling edge crossing 70% of VD
to SDA entering the 30% to 70% of VD
window.
00.9
s
tSU:STO
STOP Condition Set-up Time
From SCL rising edge crossing 70% of VD,
to SDA rising edge crossing 30% of VD
0.6
s
tR
SDA and SCL Rise Time
From 30% to 70% of VD
20 +
0.1 x Cb
ns
tF
SDA and SCL Fall Time
From 70% to 30% of VD
20 +
0.1 x Cb
ns
Cb
Capacitive Loading of SDA or SCL
Total on-chip and off-chip
400
pF
Cpin
SDA and SCL Pin Capacitance
10
pF
NOTE:
1. Parts are 100% tested at +25°C. Temperature limits established by characterization and are not production tested.
tSU:STO
tHIGH
tSU:STA
tHD:STA
tHD:DAT
SCL
SDA
(INPUT TIMING)
SDA
(OUTPUT TIMING)
tF
tLOW
tR
ISL59450
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PDF描述
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