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參數(shù)資料
| 型號(hào)： | IS80C51C-30R |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, PQCC44 |
| 文件頁數(shù)： | 20/286頁 |
| 文件大小： | 9413K |
| 代理商： | IS80C51C-30R |
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116
8183F–AVR–06/12
ATtiny24A/44A/84A
14. USI – Universal Serial Interface
14.1
Features
Two-wire Synchronous Data Transfer (Master or Slave)
Three-wire Synchronous Data Transfer (Master or Slave)
Data Received Interrupt
Wakeup from Idle Mode
In Two-wire Mode: Wake-up from All Sleep Modes, Including Power-down Mode
Two-wire Start Condition Detector with Interrupt Capability
14.2
Overview
The Universal Serial Interface (USI), provides the basic hardware resources needed for serial
communication. Combined with a minimum of control software, the USI allows significantly
higher transfer rates and uses less code space than solutions based on software only. Interrupts
are included to minimize the processor load.
A simplified block diagram of the USI is shown in Figure 14-1 For actual placement of I/O pins
refer to “Pinout of ATtiny24A/44A/84A” on page 2. Device-specific I/O Register and bit locations
are listed in the “Register Descriptions” on page 123.
Figure 14-1.
Universal Serial Interface, Block Diagram
The 8-bit USI Data Register (USIDR) contains the incoming and outgoing data. It is directly
accessible via the data bus but a copy of the contents is also placed in the USI Buffer Register
(USIBR) where it can be retrieved later. If reading the USI Data Register directly, the register
must be read as quickly as possible to ensure that no data is lost.
The most significant bit of the USI Data Register is connected to one of two output pins (depend-
ing on the mode configuration, see “Analog Comparator” on page 128). There is a transparent
latch between the output of the USI Data Register and the output pin, which delays the change
of data output to the opposite clock edge of the data input sampling. The serial input is always
sampled from the Data Input (DI) pin independent of the configuration.
DATA
BUS
USIPF
USITC
USICLK
USICS0
USICS1
USIOIF
USIOIE
USIDC
USISIF
USIWM0
USIWM1
USISIE
Bit7
Two-wire Clock
Control Unit
DO
(Output only)
DI/SDA
(Input/Open Drain)
USCK/SCL
(Input/Open Drain)
4-bit Counter
USIDR
USISR
DQ
LE
USICR
CLOCK
HOLD
TIM0 COMP
Bit0
[1]
3
0
1
2
3
0
1
2
0
1
2
USIBR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MD80C52EXXX-30SCD | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CDIP40 |
| MQ80C154-30P883R | 8-BIT, 30 MHz, MICROCONTROLLER, CQFP44 |
| MQ80C52EXXX-16SC | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQFP44 |
| MD80C32-30/883 | 8-BIT, 30 MHz, MICROCONTROLLER, CDIP40 |
| MF180C51T-16R | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IS80C51C-36 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IS80C51C-L16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IS80C51-L16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IS80C51PL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC |
| IS80C51T-12 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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