參數(shù)資料
型號(hào)： IFD-53110
英文描述： Silicon Bipolar MMIC 3.5 and 5.5 GHz Divide-by-4 Static Prescalers
中文描述： 硅雙極單片3.5和5.5 GHz的分頻4靜態(tài)分頻器
文件頁數(shù)： 4/5頁
文件大?。?/td> 86K
代理商： IFD-53110
7-154
Figure 9. Typical ECL Biasing Configuration, IFD-53010 and IFD-53110.
Figure 11. Typical Stabilized LO Configuration, IFD-53010 and IFD-53110.
Figure 10. Typical RF Biasing Configuration, IFD-53010 and IFD-53110.
4
1
3
2
V = -5.0 V
C
BL
C
BY
(47 nF min.)
V = 0 V
PIN:
CC
V
F
RF INPUT
(50 )
C
BL
F/4
RF OUTPUT
(50 )
SWINGS BETWEEN V
AND V -360 mV
CC
BLOCKING CAPACITORS ARE 1000 pF TYP.
BYPASS CAPACITORS ARE 47 nF min.
BLOCKING CAPACITORS MAY BE OMITTED
IF GENERATOR AND LOAD ARE AT V LEVEL.
TRANSMISSION LINES ARE 50 .
4
1
3
2
V = 5.0 V
C
BL
C
BY
(47 nF min.)
PIN:
F
RF INPUT
(50 )
C
BL
F/4
RF OUTPUT
(50 )
BLOCKING CAPACITORS ARE 1000 pF TYP.
BYPASS CAPACITOR SHOULD BE 47 nF min.
TO ENSURE GOOD SENSITIVITY PERFORMANCE.
TRANSMISSION LINES ARE 50 .
V = 0 V
LO OUTPUT
DIV. BY 4
PROGRAMMABLE
DIVIDER
LPF
VCO
PHASE DETECTOR
STABLE REFERENCE
AFC
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