參數(shù)資料
型號: IDTCV132BPVG
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘產(chǎn)生/分配
英文描述: 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝: GREEN, SSOP-56
文件頁數(shù): 1/13頁
文件大?。?/td> 80K
代理商: IDTCV132BPVG
COMMERCIALTEMPERATURERANGE
IDTCV132B
PROGRAMMABLEFLEXPC CLOCKFORP4PROCESSOR
1
JANUARY 2005
IDTCV132B
ADVANCE
INFORMATION
COMMERCIAL TEMPERATURE RANGE
PROGRAMMABLE FLEXPC
CLOCK FOR P4 PROCESSOR
3V66/PCI
Output Buffers
PCI[6:0], PCIF[2:0]
3V66[4:0]
SRC
PLL2
SSC
XTAL
Osc Amp
CPU CLK
Output Buffers
XTAL_IN
XTAL_OUT
IREF
CPU[2:0]
REF 1.0
PLL1
SSC
SM Bus
Controller
Watch Dog
Timer
Control
Logic
48MHz
Output Buffer
SDATA
SCLK
VTT_PWRGD
FSA,B
PWRDWN#
DOT48/USB48
VCH
PLL3
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2005 Integrated Device Technology, Inc.
DSC 6546/1
FEATURES:
3 PLL architecture
USB48 has 180° phase difference from DOT48 and VCH
3V66 lead PCI 1.5ns to 3.5ns
Band-gap circuit for differential output
High power-noise rejection ratio
100MHz to 200MHz CPU frequency
VCO frequency up to 1.1G
Support index block read/write
All CPU-Stop and PCI-Stop related functions are removed
Available in SSOP package
FUNCTIONAL BLOCK DIAGRAM
DESCRIPTION:
IDTCV132Bisa56pinclockdeviceforIntelspringdalechipsetandforIntel
advance P4 processors. This device also implements Band-gap referenced
IREF to reduce the impact of VDD variation on differential outputs, which can
provide more robust system performance.
KEY SPECIFICATIONS:
CPU/SRC CLK cycle to cycle jitter < 125ps
PCI CLK cycle to cycle jitter < 250ps
OUTPUTTABLE
CPU (Pair)
3V66
3V66/VCH
PCI
PCIF
REF
48MHz
SRC (Pair)
34
1
7
3
2
1
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PDF描述
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參數(shù)描述
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IDTCV133PAG 功能描述:IC FLEXPC CLK PROGR P4 56-TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:FlexPC™ 標準包裝:1,500 系列:- 類型:時鐘緩沖器/驅(qū)動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP(0.209",5.30mm 寬) 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT
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