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參數(shù)資料
| 型號： | IDTCSP2510DPGG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/9頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK DVR PLL ZDB 1:10 24TSSOP |
| 標準包裝： | 62 |
| 類型： | 驅(qū)動器，PLL，零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | 時鐘 |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 175MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 24-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 800-2000-5 CSP2510DPGG IDTCSP2510DPGG-ND |
4
0
°CTO85°CTEMPERATURERANGE
IDTCSP2510D
3.3V PHASE-LOCK LOOP CLOCK DRIVER
DC ELECTRICAL CHARACTERISTICS OVER OPERATING FREE-AIR TEMPERA-
TURE RANGE(1)
Symbol
Description
Test Conditions
VDD
Min.
Typ.
(2)
Max.
Unit
VIK
Input Clamp Voltage
II = -18mA
3V
– 1.2
V
VIH
Input HIGH Level
2
V
VIL
Input LOW Level
0.8
V
IOH = -100
μA
Min. to Max.
VDD – 0.2
VOH
HIGH Level Output Voltage
IOH = -12mA
3V
2.1
V
IOH = -6mA
3V
2.4
IOL = 100
μA
Min. to Max.
0.2
VOL
LOW Level Output Voltage
IOL = 12mA
3V
0.8
V
IOL = 6mA
3V
0.55
II
InputCurrent
VI = VDD or GND
3.6V
±5
μA
IDD
Supply Current
VI = VDD or GND, AVDD = GND,
3.6V
10
μA
IO = 0, Outputs: LOW or HIGH
ΔIDD
Change in Supply Current
One input at VDD - 0.6V, other inputs at VDD or GND
3.3V to 3.6V
500
μA
CPD
Power Dissipation Capacitance
3.6V
10
14
pF
IDDA
(3)
AVDD Power Supply Current
AVDD = 3.3V
10
mA
NOTES:
1. For Industrial devices, operating free-air temperature = -40°C to +85°C.
2. For conditions shown as Min. or Max., use the appropriate value specified under recommended operating conditions.
3. For IDD of AVDD, see TYPICAL CHARACTERISTICS.
Min.
Max.
Unit
Clock frequency
50
175
MHz
fCLOCK
Input clock duty cycle
40%
60%
Stabilizationtime(2)
1ms
TIMING REQUIREMENTS OVER OPERATING RANGE OF SUPPLY VOLTAGE AND
OPERATING FREE-AIR TEMPERATURE(1)
NOTES:
1. For Industrial devices, operating free-air temperature = -40°C to +85°C.
2. Time required for the integrated PLL circuit to obtain phase lock of its feedback signal to its reference signal. For phase lock to be obtained, a fixed-frequency, fixed-phase
reference signal must be present at CLK. Until phase lock is obtained, the specifications for propagation delay, skew, and jitter parameters given in the switching characteristics
table are not applicable.
相關PDF資料 |
PDF描述 |
|---|---|
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| V150A8H300B3 | CONVERTER MOD DC/DC 8V 300W |
| ICS511MLF | IC CLK MULTIPLIER PLL 8-SOIC |
| ICS2402MLF | IC BUFFER ZDB MULTIPLIER 8-SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| IDTCSP2510DPGG8 | 功能描述:IC CLK DVR PLL ZDB 1:10 24TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:2,000 系列:- 類型:PLL 時鐘發(fā)生器 PLL:帶旁路 輸入:LVCMOS，LVPECL 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:2:11 差分 - 輸入:輸出:是/無 頻率 - 最大:240MHz 除法器/乘法器:是/無 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應商設備封裝:32-TQFP（7x7） 包裝:帶卷 (TR) |
| IDTCSP2510DPGGI | 功能描述:IC CLK DVR PLL ZDB 1:10 24TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
| IDTCSP2510DPGGI8 | 功能描述:IC CLK DVR PLL ZDB 1:10 24TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
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