Figure 22. No Offset When FE = 0 & DE = 0" />
參數(shù)資料
型號： IDT82P2288BB8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 336/362頁
文件大?。?/td> 0K
描述： TXRX T1/J1/E1 8CHAN 256-PBGA
標(biāo)準(zhǔn)包裝： 1,000
類型： 收發(fā)器
規(guī)程： IEEE 1149.1
電源電壓： 3 V ~ 3.6 V
安裝類型： 表面貼裝
封裝/外殼： 256-BBGA
供應(yīng)商設(shè)備封裝： 256-PBGA（17x17）
包裝： 帶卷 (TR)
其它名稱： 82P2288BB8
IDT82P2288
OCTAL T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
75
March 04, 2009
Figure 22. No Offset When FE = 0 & DE = 0 In Receive Path
Figure 23. No Offset When FE = 0 & DE = 1 In Receive Path
FE = 0, DE = 0
Receive Clock Slave mode / Receive Multiplexed mode:
RSFSn / MRSFS
RSCKn / MRSCK
RSDn / MRSDA(B)
RSFSn / MRSFS
RSCKn / MRSCK
RSDn / MRSDA(B)
Receive Clock Master mode:
F-bit (T1/J1)
Bit 1 of TS0 (E1)
Bit 1 of CH1(T1/J1)
Bit 2 (T1/J1)
Bit 2 of TS0 (E1)
Bit 3 (E1)
F-bit (T1/J1)
Bit 1 of TS0 (E1)
Bit 1 of CH1(T1/J1)
Bit 2 (T1/J1)
Bit 3 (E1)
Bit 2 of TS0 (E1)
FE = 0, DE = 1
Receive Clock Slave mode / Receive Multiplexed mode:
RSFSn / MRSFS
RSCKn / MRSCK
RSDn / MRSDA(B)
RSFSn / MRSFS
RSCKn / MRSCK
RSDn / MRSDA(B)
Receive Clock Master mode:
F-bit (T1/J1)
Bit 1 of TS0 (E1)
Bit 1 of CH1(T1/J1)
Bit 2 (T1/J1)
Bit 2 of TS0 (E1)
Bit 3 (E1)
F-bit (T1/J1)
Bit 1 of TS0 (E1)
Bit 1 of CH1(T1/J1)
Bit 2 (T1/J1)
Bit 2 of TS0 (E1)
Bit 3 (E1)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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