參數(shù)資料
型號(hào)： IDT74FCT16V345PA
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 總線收發(fā)器
英文描述： FCT SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO56
封裝： TSSOP-56
文件頁(yè)數(shù)： 6/7頁(yè)
文件大?。?/td> 138K
代理商： IDT74FCT16V345PA
6
INDUSTRIALTEMPERATURERANGE
IDT74FCT16V345
3.3V FAST CMOS REGISTERED ADDRESS LINE DRIVER
Pulse
Generator
R T
D.U.T.
V CC
VIN
C L
V OUT
50pF
500
500
Open
GND
VLOAD
VIH
VT
0V
VIH
VT
0V
VIH
VT
0V
VIH
VT
0V
DATA
INPUT
TIMING
INPUT
PRESET
CLEAR
ETC.
tSU
tH
tREM
tSU
tH
HIGH-LOW-HIGH
PULSE
LOW-HIGH-LOW
PULSE
tW
VT
SAME PHASE
INPUT TRANSITION
VIH
VT
0V
VT
VOH
tPLH
OUTPUT
OPPOSITE PHASE
INPUT TRANSITION
VIH
VT
0V
tPLH
tPHL
VOL
CONTROL
INPUT
VIH
VT
0V
VLOAD/2
0V
OUTPUT
NORMALLY
LOW
OUTPUT
NORMALLY
HIGH
SWITCH
CLOSED
SWITCH
OPEN
VOL
0.3V
tPLZ
tPZL
tPZH
tPHZ
VLOAD/2
0V
VT
ENABLE
DISABLE
VOH
tPLH1
OUTPUT 1
OUTPUT 2
tSK(x)
tPLH2
3V
0V
VOH
1.5v
VOL
VOH
1.5v
VOL
INPUT
tPHL1
tPHL2
tSK(x)
tSK(x) = |tPLH2 - tPLH1| or |tPHL2 - tPLH1|
ASYNCHRONOUS CONTROL
SYNCHRONOUS CONTROL
TEST CIRCUITS AND WAVEFORMS
PROPAGATION DELAY
TEST CIRCUITS FOR ALL OUTPUTS
ENABLE AND DISABLE TIMES
SET-UP, HOLD, AND RELEASE TIMES
PULSE WIDTH
OUTPUT SKEW - tSK (x)
NOTES:
1. For tsk(b) OUTPUT1 and OUTPUT2 are in the same bank.
2. For tsk(o) OUTPUT1 and OUTPUT2 are in different banks on the same part.
NOTES:
1. Diagram shown for input Control Enable-LOW and input Control
Disable-HIGH.
2. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2.5ns; tR ≤ 2.5ns.
SWITCH POSITION
Test
Switch
Disable Low
VLOAD
Enable Low
Disable High
GND
Enable High
All Other Tests
Open
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse
Generator.
TEST VOLTAGES
Symbol
Vcc=3.3V±0.3V
Vcc=2.7V
Vcc=2.7V±0.2V
Unit
VLOAD
66
4.6
V
VIH
2.7
2.3
V
VT
1.5
1.2
V
相關(guān)PDF資料
PDF描述
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