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參數(shù)資料
| 型號： | IDT74FCT162344ETPF8 |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | FCT SERIES, LOW SKEW CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO56 |
| 封裝： | TVSOP-56 |
| 文件頁數(shù)： | 5/6頁 |
| 文件大?。?/td> | 140K |
| 代理商： | IDT74FCT162344ETPF8 |
5
IDT74FCT162344AT/CT/ET
FASTCMOSADDRESS/CLOCKDRIVER
INDUSTRIALTEMPERATURERANGE
Pulse
Generator
R T
D.U.T.
V CC
V IN
C L
V OUT
50pF
500
500
7.0V
3V
1.5V
0V
3V
1.5V
0V
3V
1.5V
0V
3V
1.5V
0V
DATA
IN PU T
TIM IN G
IN PU T
ASYN CHR ON OUS C ON TROL
PRESET
CLEAR
ETC.
SYNCHRON OU S CONT RO L
tSU
tH
tREM
tSU
tH
HIGH-LOW -H IGH
PULSE
LOW -H IGH -LOW
PULSE
tW
1.5V
SAM E PHA SE
IN PU T TRAN SIT ION
3V
1.5V
0V
1.5V
VOH
tPLH
OU TPU T
OPPOSITE P HASE
IN PU T TRAN SIT ION
3V
1.5V
0V
tPLH
tPHL
VOL
CO NTRO L
IN PU T
3V
1.5V
0V
3.5V
0V
OU TPU T
NO RM ALLY
LOW
OU TPU T
NO RM ALLY
HIGH
SW ITCH
CLOSED
SW ITCH
OPEN
VOL
0.3V
tPLZ
tPZL
tPZH
tPHZ
3.5V
0V
1.5V
ENABLE
DISABLE
VOH
PRESET
CLEAR
CLOCK ENABLE
ETC.
tPLH1
OU TPU T 1
OU TPU T 2
tSK1(o)
tPLH2
3V
0V
VOH
1.5V
VOL
VOH
1.5V
VOL
IN PU T
tPHL1
tPHL2
tSK1(o)
tSKn(o) = |tPLH2 - tPLH1| or |tPHL2 - tPLH1|
TEST CIRCUITS AND WAVEFORMS
Propagation Delay
Test Circuits for All Outputs
Enable and Disable Times
Set-up, Hold, and Release Times
Pulse Width
Output Skew – tSKn(o)
Test
Switch
Open Drain
Disable Low
Closed
Enable Low
All Other Tests
Open
SWITCH POSITION
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
NOTES:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH.
2. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2.5ns; tR ≤ 2.5ns.
NOTES:
1. For tSK1(o) OUTPUT1 and OUTPUT2 are in the same bank.
2. For tSK2(o) OUTPUT1 and OUTPUT2 are in different banks on the same part.
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PDF描述 |
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