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參數(shù)資料
| 型號： | IDT72V51456L7-5BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 42/57頁 |
| 文件大小： | 0K |
| 描述： | IC FLOW CTRL MULTI QUEUE 256-BGA |
| 標準包裝： | 1 |
| 類型： | 多隊列流量控制 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BBGA |
| 供應商設備封裝： | 256-BGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 72V51456L7-5BB |
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47
IDT72V51436/72V51446/72V51456 3.3V, MULTI-QUEUE FLOW-CONTROL DEVICES
(16 QUEUES) 36 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
Figure 26.
PAEn/PRn - Direct Mode - Sector Selection
RCLK
tSTH
tSTS
tQH
tQS
001xxxx1
5935 drw29
RDADD
ESTR
Device 1
Sector 2
tQS
tQH
001xxxx0
Device 1
Sector 1
tQS
tQH
001xxxx1
Device 1
Sector 2
tSTS
tSTH
PAEn/
PRn
tPAE
Device 1 Sector 2
Device 1 Sector 1
tPAE
Device 1 Sector 2
Figure 27.
PAFn - Direct Mode - Sector Selection
WCLK
tSTH
tSTS
tQH
tQS
001xxx0
5935 drw30
WRADD
FSTR
Device 1
Sector 1
tQS
tQH
001xxx1
Device 1
Sector 2
tQS
tQH
001xxx0
Device 1
Sector 1
tSTS
tSTH
PAFn
tPAF
Device 1 Sector 1
Device 1 Sector 3
tPAF
Device 1 Sector 1
NOTES:
1. Sectors can be selected on consecutive cycles.
2. On an RCLK cycle that the ESTR is HIGH, the RADEN input must be LOW.
3. There is a latency of 1 RCLK for the
PAEn bus to switch.
NOTES:
1. Sectors can be selected on consecutive cycles.
2. On a WCLK cycle that the FSTR is HIGH, the WADEN input must be LOW.
3. There is a latency of 1 WCLK for the
PAFn bus to switch.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT72V51453L7-5BB | IC FLOW CTRL MULTI QUEUE 256-BGA |
| LFXP10E-5FN388C | IC FPGA 9.7KLUTS 388FPBGA |
| LT1175IS8#TRPBF | IC REG LDO NEG ADJ .5A 8SOIC |
| LT1175IS8#TR | IC REG LDO NEG ADJ .5A 8SOIC |
| LT1175IT-5#PBF | IC REG LDO -5V .5A TO220 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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