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參數資料
| 型號： | IDT72V51433L6BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 31/50頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FLOW CTRL MULTI QUEUE 256-BGA |
| 標準包裝： | 1 |
| 類型： | 多隊列流量控制 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BBGA |
| 供應商設備封裝： | 256-BGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 72V51433L6BB |
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37
IDT72V51433/72V51443/72V51453 3.3V, MULTI-QUEUE FLOW-CONTROL DEVICES
(16 QUEUES) 18 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
RCLK
RADEN
Qout
REN
tAH
tAS
0001xxxx
RDADD
tA
NULL QUEUE
SELECT
*A*
*B*
*C*
*E*
*F*
tQH
tENS
Q1 Wn-3
Q1 Wn-2
Q1 Wn-1
tA
tA
Q4 W0
FWFT
OV
tROV
5938 drw18
SELECT
NEW QUEUE
*D*
00000100
tAH
tAS
tQH
tQS
tENH
tQS
Figure 16. Read Operation and Null Queue Select
NOTES:
1. The purpose of the Null queue operation is so that the user can stop reading a block (packet) of data from a queue without filling the 2 stage output pipeline with the next words
from that queue.
2. Please see Figure 17, Null Queue Flow Diagram.
Cycle:
*A* Null Q of device 0 (32nd queue) is selected, when word Wn-1 from previously selected Q1 is read.
*B*
REN is HIGH and Wn (Last Word of the Packet) of Q1 is pipelined onto the O/P register.
Note: *B* and *C* are a minimum 2 RCLK cycles between Q selects.
*C* The Null Q is seen as an empty queue on the read side, therefore Wn of Q1 remains in the O/P register and
OV goes HIGH.
*D* A new Q, Q4 is selected and the 1st word of Q4 will fall through present on the O/P register on cycle *F*.
5939 drw19
Queue 1
Memory
*A*
Null
Queue
*B*
Null
Queue
*C*
O/P Reg.
*D*
*E*
*F*
Null
Queue
Queue 4
Memory
Q1
Wn
Queue 4
Memory
O/P Reg.
Qn
Wn-1
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q4
W0
Q1
Wn
Q4
W1
Q4
W0
Figure 17. Null Queue Flow Diagram
相關PDF資料 |
PDF描述 |
|---|---|
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| ACB64DHHR | CONN EDGECARD 128PS .050 DIP SLD |
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| ABB64DHHR | CONN EDGECARD 128PS .050 DIP SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
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