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參數資料
| 型號： | IDT72V3612L20PQF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 8/24頁 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 20NS 132QFP |
| 標準包裝： | 36 |
| 系列： | 72V |
| 功能： | 異步 |
| 存儲容量： | 4.6K（64 x 36 x2） |
| 數據速率： | 50MHz |
| 訪問時間： | 20ns |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 132-BQFP 緩沖式 |
| 供應商設備封裝： | 132-PQFP（24.13x24.13） |
| 包裝： | 托盤 |
| 其它名稱： | 72V3612L20PQF |
16
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTE:
1. tSKEW1 is the minimum time between a rising CLKB edge and a rising CLKA edge for EFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKB edge and
rising CLKA edge is less than tSKEW1, then the transition of EFA HIGH may occur one CLKA cycle later than shown.
Figure 8. EFA
EFA
EFA Flag Timing and First Data Read when FIFO2 is Empty
CSB
W/
RB
MBB
FFB
B0 - B35
CLKA
EFA
CSA
W/
RA
MBA
ENB
ENA
A0 -A35
CLKB
12
4659 drw 11
tCLKH
tCLKL
tCLK
tENS3
tENS2
tENH3
tENH2
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH2
tA
W1
FIFO2 Empty
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
tREF
相關PDF資料 |
PDF描述 |
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| IDT72V3614L20PF | IC FIFO 64X36X2 20NS 120QFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| IDT72V3613L12PQF | 功能描述:IC FIFO CLOCK 64X36 12NS 132PQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數據速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF |
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| IDT72V3613L15PF8 | 功能描述:IC FIFO CLOCK 64X36 15NS 120TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數據速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF |
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