IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO
參數(shù)資料
型號： IDT72T18115L10BB
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 43/55頁
文件大?。?/td> 0K
描述： IC FIFO 262KX18 2.5V 10NS 240BGA
標(biāo)準(zhǔn)包裝： 1
系列： 72T
功能： 異步
存儲容量： 4.7Mb（262k x 18）
數(shù)據(jù)速率： 10MHz
訪問時間： 10ns
電源電壓： 2.375 V ~ 2.625 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 240-BGA
供應(yīng)商設(shè)備封裝： 240-PBGA（19x19）
包裝： 托盤
其它名稱： 72T18115L10BB
48
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO 2Kx18/4Kx9, 4Kx18/
8Kx9, 8Kx18/16Kx9, 16Kx18/32Kx9, 32Kx18/64Kx9, 64Kx18/128Kx9, 128Kx18/256Kx9, 256Kx18/512Kx9, 512Kx18/1Mx9
FEBRUARY 10, 2009
Figure
28.
Echo
Read
Clock
&
Read
Enable
Operation
(IDT
Standard
Mode
Only)
tENS
tENH
tENS
RCS
RCLK
REN
Qn
tERCLK
tENS
5909
drw32
ERCLK
tENH
EREN
tCLKEN
tREF
EF
W
D-4
tA
tOLZ
tOHZ
tA
tOLZ
tA
Last
Word,
W
D
W
D-3
W
D-3
W
D-2
W
D-1
tCLKEN
NOTES:
1
.
The
EREN
output
is
an
“ANDed”
function
of
RCS
and
REN
and
will
follow
these
inputs
provided
that
the
FIFO
is
not
empty.
If
the
FIFO
is
empty,
EREN
will
go
HIGH,
thus
preventing
any
reads.
2
.
The
EREN
output
is
synchronous
to
RCLK.
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