tSKEW1
參數(shù)資料
型號(hào)： IDT72605L50PF8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 3/17頁(yè)
文件大小： 0K
描述： IC FIFO BI SYNC 256X18 64-TQFP
標(biāo)準(zhǔn)包裝： 750
系列： 7200
功能： 同步
存儲(chǔ)容量： 9.2K（512 x 18）
訪問(wèn)時(shí)間： 50ns
電源電壓： 4.5 V ~ 5.5 V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-TQFP（14x14）
包裝： 帶卷 (TR)
其它名稱(chēng)： 72605L50PF8
11
IDT72605/72615 CMOS SYNCBiFIFO
256 x 18x 2 and 512 x 18 x 2
INDUSTRIALTEMPERATURERANGE
VALID DATA
tSKEW1
NO WRITE OPERATION
CLKB
ENB
R/
WB
EFBA
DB0-DB17
CLKA
NO OPERATION
tEF
tCS
tCH
tCLKL
tCLKH
tCLK
OEB
tA
WRITE
tOE
tOLZ
tOHZ
2704 drw 10
(First Valid Write)
(1)
tSKEW1
CLKA
ENB
R/
WA
EFAB
DB0-DB17
CLKB
tEF
tCS
OEB
tA
tOE
tOLZ
R/
WB
DA0-DA17
CSA, ENA
A0, A1, A2
tA
tFRL
tCS
D0
D1
D2
D3
D0
tDS
2704 drw 11
Figure 7. Port B (A
→
→B) Read Timing
NOTE:
1. When tSKEW1
≥ minimum specification, tFRL(Max.) = tCLK + tSKEW1
tSKEW1 < minimum specification, tFRL(Max.) = 2tCLK + tSKEW1 or tCLK + tSKEW1
The Latency Timing applies only at the Empty Boundary (EF = LOW).
Figure 8. A
→
→B First Data Word Latency after Reset for Simultaneous Read and Write
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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