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參數(shù)資料
| 型號： | IDT72605L25PF8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 5/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIFO BI SYNC 256X18 64-TQFP |
| 標準包裝： | 750 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存儲容量： | 9.2K（512 x 18） |
| 數(shù)據(jù)速率： | 40MHz |
| 訪問時間： | 25ns |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應商設(shè)備封裝： | 64-TQFP（14x14） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 72605L25PF8 |
13
IDT72605/72615 CMOS SYNCBiFIFO
256 x 18x 2 and 512 x 18 x 2
INDUSTRIALTEMPERATURERANGE
DATA INPUT
BYPASS FLAG
tSKEW1
CLKB
ENB
R/
WB
FFAB
DA0-DA17
CLKA
tCS
OEB
tA
tOE
tOLZ
R/
WA
DB0-DB17
ENA
A0, A1, A2
tDS
2704 drw 13
CSA
EFAB
BYPB
A2, A1, A0 = 001
tFF
tCH
tCS
tFF
tEF
tOHZ
DATA OUTPUT
FIFO FLAG
BYPASS FLAG
FIFO FLAG
tSKEW1
tCH
NOTES:
1. When CSA is brought HIGH, A
→B Bypass mode will switch to FIFO mode on the following CLKA LOW-to-HIGH transition.
2. After the bypass operation is completed, the BYPB goes from LOW-to-HIGH; this will reset all bypass flags. The bypass path becomes available for the next bypass
operation.
3. When A-side changed from bypass mode into FIFO mode, B-side only has one cycle to read the bypass data. On the next cycle, B-side will be forced back to FIFO
mode.
Figure 10. A
→
→B Bypass Timing
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PDF描述 |
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參數(shù)描述 |
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