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參數(shù)資料
| 型號(hào)： | IDT72401L45SOG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/9頁 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X4 PAR 45NS 16SOIC |
| 標(biāo)準(zhǔn)包裝： | 46 |
| 系列： | 7200 |
| 功能： | 異步 |
| 存儲(chǔ)容量： | 256（64 x 4） |
| 訪問時(shí)間： | 45ns |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOIC |
| 包裝： | 管件 |
MILITARY AND COMMERCIAL
TEMPERATURE RANGES
IDT72401/72403
CMOS PARALLEL FIFO 64 x 4, 64 x 5
4
JUNE 29, 2012
560
Ω
30pF*
1.1K
Ω
5V
OUTPUT
2747 drw 05
Input Pulse Levels
GND to 3.0V
InputRise/FallTimes
3ns
InputTimingReferenceLevels
1.5V
OutputReferenceLevels
1.5V
OutputLoad
See Figure 1
ALL INPUT PULSES:
SIGNAL DESCRIPTIONS
INPUTS:
DATA INPUT (D0-3)
Data input lines. The IDT72401 and IDT72403 have a 4-bit data input.
CONTROLS:
SHIFT IN (SI)
Shift In controls the input of the data into the FIFO. When SI is HIGH, data
can be written to the FIFO via the D0-3 lines.
SHIFT OUT (SO)
ShiftOutcontrolstheoutputofdataoftheFIFO. WhenSOisHIGH,datacan
be read from the FIFO via the Data Output (Q0-3) lines.
MASTER RESET (MR)
MasterResetclearstheFIFOofanydatastoredwithin. Uponpowerup,the
FIFO should be cleared with a MR. MR is active LOW.
INPUT READY (IR)
WhenInputReadyisHIGH,theFIFOisreadyfornewinputdatatobewritten
toit.WhenIRisLOWtheFIFOisunavailablefornewinputdata. IRisalsoused
to cascade many FlFOs together, as shown in Figures 10 and 11.
OUTPUT READY (OR)
WhenOutputReadyisHIGH,theoutput(Q0-3)containsvaliddata. When
OR is LOW, the FIFO is unavailable for new output data. OR is also used to
cascade many FlFOs together, as shown in Figures 10 and 11.
OUTPUT ENABLE (OE) (IDT72403 ONLY)
Output enable is used to read FIFO data onto a bus. OE is active LOW.
OUTPUTS:
DATAOUTPUT(Q0-3)
DataOutputlines.TheIDT72401andIDT72403havea4-bitdataoutput.
orequivalentcircuit
Figure 1. AC Test Load
*Includingscopeandjig
Symbol
Parameter
Conditions
Max.
Unit
CIN
InputCapacitance
VIN = 0V
5
pF
COUT
OutputCapacitance
VOUT = 0V
7
pF
NOTE:
1. Characterized values, not currently tested.
2747 drw 04
GND
3.0V
90%
10%
90%
10%
<3ns
AC TEST CONDITIONS
CAPACITANCE
(TA = +25°C, f = 1.0MHz)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT72413L45P | IC FIFO PAR W/FLAGS 32KB 20DIP |
| IDT72615L20J | IC FIFO BY SYNC 512X18X2 68PLCC |
| IDT72825LB15BGG | IC FIFO 1024X18 SYNC DL 128TQFP |
| IDT72851L15TFI | IC FIFO SYNC DUAL 8192X9 64QFP |
| IDT7285L15PAI | IC FIFO 4096X18 15NS 56TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT72401L45SOG8 | 制造商:Integrated Device Technology Inc 功能描述:IC FIFO PAR 64X4 45NS 16-SOIC |
| IDT72403L10DB | 制造商:Integrated Device Technology Inc 功能描述:IC FIFO ASYNC 64X4 10NS 16CDIP |
| IDT72403L10P | 功能描述:IC FIFO PAR 64X4 10NS 16-DIP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:80 系列:7200 功能:同步 存儲(chǔ)容量:18.4K（1K x 18） 數(shù)據(jù)速率:- 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（10x10） 包裝:托盤 其它名稱:72225LB10TF |
| IDT72403L10SO | 功能描述:IC FIFO PAR 64X4 10NS 16-SOIC RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:80 系列:7200 功能:同步 存儲(chǔ)容量:18.4K（1K x 18） 數(shù)據(jù)速率:- 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（10x10） 包裝:托盤 其它名稱:72225LB10TF |
| IDT72403L10SO8 | 功能描述:IC FIFO PAR 64X4 10NS 16-SOIC RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:80 系列:7200 功能:同步 存儲(chǔ)容量:18.4K（1K x 18） 數(shù)據(jù)速率:- 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（10x10） 包裝:托盤 其它名稱:72225LB10TF |
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