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參數(shù)資料
| 型號： | IDT723676L12PF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 21/39頁 |
| 文件大小： | 0K |
| 描述： | IC FIFO SYNC 16384X36 128QFP |
| 標(biāo)準(zhǔn)包裝： | 36 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存儲容量： | 576K（16K x 36） |
| 數(shù)據(jù)速率： | 83MHz |
| 訪問時間： | 12ns |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 128-TQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 723676L12PF |
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28
IDT723656/723666/723676 CMOS TRIPLE BUS SyncFIFOTM WITH
BUS MATCHING 2,048 x 36 x 2, 4,096 x 36 x 2 and 8,192 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTES:
1. tSKEW1 is the minimum time between a rising CLKC edge and a rising CLKA edge for
EFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKC edge and rising
CLKA edge is less than tSKEW1, then the transition of
EFA HIGH may occur one CLKA cycle later than shown.
2. If Port C size is word or byte, tSKEW1 is referenced to the rising CLKC edge that writes the last word or byte of the long word, respectively.
Figure 19.
EFA
EFA Flag Timing and First Data Read when FIFO2 is Empty (IDT Standard Mode)
MBC
FFC
C0-C17
CLKA
EFA
CSA
W/RA
MBA
WENC
ENA
A0-A35
CLKC
12
5611 drw20
tCLKH
tCLKL
tCLK
tENS2
tENH
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH
tA
W1
FIFO2 Empty
LOW
tCLKH
HIGH
(1)
tREF
tDH
tDS
Write 1
Write 2
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PDF描述 |
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| IDT723676L15PF8 | 功能描述:IC FIFO SYNC 16384X36 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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