參數(shù)資料
型號(hào): IDT72291L20TFI
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 14/26頁(yè)
文件大小: 0K
描述: IC FIFO 65536X18 LP 20NS 64QFP
標(biāo)準(zhǔn)包裝: 80
系列: 7200
功能: 同步
存儲(chǔ)容量: 1.1M(65K x 18)
數(shù)據(jù)速率: 50MHz
訪問時(shí)間: 20ns
電源電壓: 4.5 V ~ 5.5 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(10x10)
包裝: 托盤
其它名稱: 72291L20TFI
21
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72281/72291
CMOS SuperSync FIFO 65,536 x 9 and 131,072 x 9
NOTES:
1. Retransmit setup is complete after OR returns LOW.
2. No more than D – 2 words may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore, IR will be LOW throughout the Retransmit setup
procedure. D = 65,537 for the IDT72281 and 131,073 for the IDT72291.
3. OE = LOW.
4. W1, W2, W3 = first, second and third words written to the FIFO after Master Reset.
5. OR goes LOW at 60 ns + 2 RCLK cycles + tREF.
Figure 12. Retransmit Timing (FWFT Mode)
Figure 13. Serial Loading of Programmable Flag Registers (IDT Standard and FWFT Modes)
WCLK
SEN
SI
4675 drw16
tENH
tENS
tLDS
LD
tDS
BIT 0
EMPTY OFFSET
BIT X
BIT 0
FULL OFFSET
(1)
tENH
BIT X
(1)
tLDH
tDH
tREF
tENH
4675 drw 15
tENS
Wx
WCLK
RCLK
REN
RT
OR
PAF
HF
PAE
Q0 - Qn
tSKEW2
12
1
tHF
tPAE
tREF
Wx+1
2
W2
tENH
WEN
tENS
W1
tENH
(4)
(5)
3
4
tENH
W3
tRTS
tA
tRTS
tPAF
NOTE:
1. X = 15 for the IDT72281 and X = 16 for the IDT72291.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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