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參數(shù)資料
| 型號： | IDT5V9950 |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | Scan Test Devices With 18-Bit Bus Transceivers And Registers 64-LQFP -40 to 85 |
| 中文描述： | 3.3V的可編程相偏PLL時鐘驅(qū)動器TURBOCLOCK |
| 文件頁數(shù)： | 4/9頁 |
| 文件大?。?/td> | 67K |
| 代理商： | IDT5V9950 |
4
INDUSTRIAL TEMPERATURE RANGE
IDT5V9950
3.3V PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK II JR.
CONTROL SUMMARY TABLE FOR FEEDBACK SIGNALS
nF1:0
Skew (Pair #1, #2)
LL
(1)
LM
LH
ML
MM
Zero Skew
MH
HL
HM
HH
Skew (Pair #3)
Divide by 2
–6t
U
–4t
U
–2t
U
Zero Skew
2t
U
4t
U
6t
U
Divide by 4
Skew (Pair #4)
Divide by 2
–6t
U
–4t
U
–2t
U
Zero Skew
2t
U
4t
U
6t
U
Inverted
(2)
–4t
U
–3t
U
–2t
U
–1t
U
1t
U
2t
U
3t
U
4t
U
NOTES:
1. LL disables outputs if TEST = MID and
sOE
= HIGH.
2. When pair #4 is set to HH (inverted),
sOE
disables pair #4 HIGH when PE = HIGH,
sOE
disables pair #4 LOW when PE = LOW.
RECOMMENDED OPERATING RANGE
Symbol
Description
V
DD
/V
DDQ
Power Supply Voltage
T
A
Ambient Operating Temperature
Min.
3
-40
Typ.
3.3
+25
Max.
3.6
+85
Unit
V
°C
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE
Symbol
V
IH
V
IL
V
IHH
V
IMM
V
ILL
I
IN
Parameter
Conditions
Min.
2
—
V
DD
0.6
V
DD
/2
0.3
—
5
Max.
—
0.8
—
Unit
V
V
V
V
V
μA
Input HIGH Voltage
Input LOW Voltage
Input HIGH Voltage
(1)
Input MID Voltage
(1)
Input LOW Voltage
(1)
Input Leakage Current
(REF, FB Inputs Only)
Guaranteed Logic HIGH (REF, FB Inputs Only)
Guaranteed Logic LOW (REF, FB Inputs Only)
3-Level Inputs Only
3-Level Inputs Only
3-Level Inputs Only
V
IN
= V
DD
or GND
V
DD
= Max.
V
IN
= V
DD
V
IN
= V
DD
/2
V
IN
= GND
V
DD
= Max., V
IN
= GND
V
DD
= Max., V
IN
= V
DD
V
DDQ
= Mn., I
OH
=
12mA
V
DDQ
= Mn., I
OL
= 12mA
V
DD
/2+0.3
0.6
+5
HIGH Level
MID Level
LOW Level
—
50
200
100
—
2.4
—
+200
+50
—
—
+100
—
0.4
I
3
3-Level Input DC Current (TEST, FS, nF
[1:0]
)
μA
I
PU
I
PD
V
OH
V
OL
Input Pull-Up Current (PE)
Input Pull-Down Current (
sOE
)
Output HIGH Voltage
Output LOW Voltage
μA
μA
V
V
NOTE:
1.
These inputs are normally wired to V
DD
, GND, or unconnected. Internal termnation resistors bias unconnected inputs to V
DD
/2. If these inputs are switched, the function and
timng of the outputs may be glitched, and the PLL may require an additional t
LOCK
time before all datasheet limts are achieved.
相關(guān)PDF資料 |
PDF描述 |
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| IDT5V9950PFI | Scan Test Devices With 18-Bit Bus Transceivers And Registers 64-LQFP -40 to 85 |
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| IDT5V995 | 3.3V PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK |
| IDT5V995PFGI | 3.3V PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK |
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