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參數(shù)資料
| 型號： | IDT5V9351PRI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | LOW VOLTAGE PLL CLOCK DRIVER |
| 中文描述： | PLL BASED CLOCK DRIVER, 9 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封裝： | TQFP-32 |
| 文件頁數(shù)： | 3/10頁 |
| 文件大?。?/td> | 85K |
| 代理商： | IDT5V9351PRI |
INDUSTRIAL TEMPERATURE RANGE
IDT5V9351
LOW VOLTAGE PLL CLOCK DRIVER
3
Terminal
Name
PECL-CLK
PECL-CLK
TCLK
FBIN
REF_SEL
f
SEL(D:A)
OE
Q
A
Q
B
Q
C (1:0)
Q
D (4:0)
No.
8, 9
Type
I
Description
Differential clock reference, LOW voltage positive ECL input
30
2
32
I
I
I
I
I
Single-ended reference clock signal or test clock
Feedback signal input
Reference clock input
Frequency control pin
Output enable/disable
Bank A clock output
Bank B clock output
Bank C clock output
Bank D clock output
3, 4, 5, 6
10
28
26
22, 24
12, 14, 16,
18, 20
1
11, 15, 19,
23, 27
7, 13, 17, 21,
25, 29
31
O
O
O
O
V
CCA
V
CC
PWR
PWR
Positive power supply for PLL
Positive power supply for I/O and core
GND
Ground
Negative power supply
PLL_EN
I
PLL enable input. When set HIGH, PLL is enabled. When set LOW, PLL is disabled.
PIN DESCRIPTION
FUNCTIONALITY
Control
REF_SEL
PLL_EN
OE
FSELA
FSELB
FSELC
FSELD
Default
0
1
0
0
0
0
0
0
1
Selects PECL_CLK as reference clock
Test mode with PLL Disabled
Outputs enabled
Q
A
= V
CO
÷
2
Q
B
= V
CO
÷
4
Q
C
= V
CO
÷
4
Q
D
= V
CO
÷
4
Selects TCLK as reference clock
PLL Enabled
Outputs disabled
Q
A
= V
CO
÷
4
Q
B
= V
CO
÷
8
Q
C
= V
CO
÷
8
Q
D
= V
CO
÷
8
NOTE:
1. Output frequency relationship with respect to input reference frequency CLK. QC1 is connected to FBIN.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT5V9351 | LOW VOLTAGE PLL CLOCK DRIVER |
| IDT5V9351PR | LOW VOLTAGE PLL CLOCK DRIVER |
| IDT5V9352 | 3.3V/2.5V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER |
| IDT5V9352PRI | 3.3V/2.5V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER |
| IDT5V9910A-7SOI | 3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| IDT5V9352PFGI | 功能描述:IC BUFFER ZD PLL CLK DVR 32-LQFP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
| IDT5V9352PFGI8 | 功能描述:IC BUFFER ZD PLL CLK DVR 32-LQFP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
| IDT5V9855-003PFI | 制造商:INT_DEV_TECH 功能描述: |
| IDT5V9885ANLGI | 制造商:Integrated Device Technology Inc 功能描述: |
| IDT5V9885BNLGI | 功能描述:IC CLK GEN 3.3V EEPROM 28-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:39 系列:- 類型:* PLL:帶旁路 輸入:時鐘 輸出:時鐘 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 頻率 - 最大:170MHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:* 封裝/外殼:* 供應商設備封裝:* 包裝:* |
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