V
參數(shù)資料
型號(hào)： IDT5V2310NRGI8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 3/9頁
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描述： IC CLK BUFF 1:10 200MHZ 20VFQFPN
產(chǎn)品變化通告： Product Discontinuation 11/Nov/2011
標(biāo)準(zhǔn)包裝： 4,500
類型： 扇出緩沖器（分配）
電路數(shù)： 1
比率 - 輸入:輸出： 1:10
差分 - 輸入:輸出： 無/無
輸入： LVTTL
輸出： LVTTL
頻率 - 最大： 200MHz
電源電壓： 2.3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 20-VFQFPN（3.5x4.5）
包裝： 帶卷 (TR)
其它名稱： 5V2310NRGI8
3
INDUSTRIALTEMPERATURERANGE
IDT5V2310
2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER
Symbol
Description
Min.
Typ.
Max.
Unit
VDD
InternalPowerSupplyVoltage
2.3
2.5
V
3.3
3.6
VIL
InputVoltageLOW
VDD = 3V to 3.6V
0.8
V
VDD = 2.3V to 2.7V
0.7
VIH
Input Voltage HIGH
VDD = 3V to 3.6V
2
V
VDD = 2.3V to 2.7V
1.7
VI
InputVoltage
0
VDD
V
IOH
Output Current HIGH
VDD = 3V to 3.6V
-12
mA
VDD = 2.3V to 2.7V
-6
IOL
OutputCurrentLOW
VDD = 3V to 3.6V
12
mA
VDD = 2.3V to 2.7V
6
TA
AmbientOperatingTemperature
-40
+85
°C
RECOMMENDEDOPERATINGRANGE
NOTE:
1. All typical values are at respective nominal VDD.
DC ELECTRICAL CHARACTERISTICS - VDD = 3.3V ± 0.3V
Symbol
Parameter
Test Conditions
Min.
Typ.(1)
Max
Unit
VDD = Min. to Max.
IOH = -100
μAVDD - 0.2
VOH
HIGH level Output Voltage
VDD = 3V
IOH = -12mA
2.1
V
IOH = -6mA
2.4
VDD = Min. to Max.
IOL = 100
μA
0.2
VOL
LOWlevelOutputVoltage
VDD = 3V
IOL = 12mA
0.8
V
IOL = 6mA
0.55
VDD = 3V
VO = 1V
-28
IOH
HIGH level Output Current
VDD = 3.3V
VO = 1.65V
-36
mA
VDD = 3.6V
VO = 3.135V
-14
VDD = 3V
VO = 1.95V
28
IOL
LOWlevelOutputCurrent
VDD = 3.3V
VO = 1.65V
36
mA
VDD = 3.6V
VO = 0.4V
14
NOTE:
1. For IDD over frequency, see TEST CIRCUIT AND WAVEFORMS.
DC ELECTRICALCHARACTERISTICS OVER OPERATING RANGE
Symbol
Parameter
Test Conditions
Min.
Typ.
Max
Unit
VIK
InputVoltage
VDD = 3V, IIN = -18mA
- 1.2
V
IIN
InputCurrent
VI = 0V or VDD
±5
μA
IDD
StaticDeviceCurrent(1)
CLK = 0V or VDD, IO = 0mA, VDD = 3.3V
25
μA
PINDESCRIPTION
TERMINAL
Symbol
I/O
Description
1G
I
Output Enable Control for 1Y(0:4) Outputs. This output enable is active HIGH. If this pin is Logic HIGH, the 1Y(0:4) clock outputs will follow the
input clock (CLK). If this pin is logic LOW, the 1Y(0:4) outputs will drive low independent of the state of CLK.
2G
I
Output Enable Control for 2Y(0:4) Outputs. This output enable is active HIGH. If this pin is Logic HIGH, the 2Y(0:4) clock outputs will follow the
input clock (CLK). If this pin is logic LOW, the 2Y(0:4) outputs will drive low independent of the state of CLK.
1
Y(0:4)
O
BufferedOutputClocks
2
Y(0:4)
O
BufferedOutputClocks
CLK
I
InputReferenceFrequency
GND
Ground
VDD
PWR
DC Power Supply, 2.3V to 3.6V
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PDF描述
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